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[VHDL编程sssd

说明:MB CARD FPGA ENTERANCE FOR production lines to inc. process quality and monitoring process step by step phase for better under standing of manufac turing
<hirrimi> 在 2025-01-20 上传 | 大小:7kb | 下载:0

[VHDL编程ac97_latest.tar

说明:AC97 verilog source code
<jackey zhou> 在 2025-01-20 上传 | 大小:89kb | 下载:0

[VHDL编程time

说明:年月日时分秒计时器,基于VHDL的表,爱爱爱啊-YYMMDDHHMMSS timer
<孟祥> 在 2025-01-20 上传 | 大小:2.41mb | 下载:0

[VHDL编程fpga_fmsc

说明:本代码在FPGA上实现了与STM32单片机的FSMC总线通信的时序代码,在ALTERA FPGA上得到验证。-The code on the FPGA to achieve with the STM32 microcontroller timing code FSMC bus communication is verified on ALTERA FPGA.
<Yang Lv> 在 2025-01-20 上传 | 大小:11kb | 下载:0

[VHDL编程stm32f103_ad9854

说明:使用STM32F103RBT6单片机实现的AD9854的驱动程序,可以实现输出指定频率的正弦信号。-Use STM32F103RBT6 MCU AD9854 driver can specify a sinusoidal output signal frequency.
<Yang Lv> 在 2025-01-20 上传 | 大小:244kb | 下载:0

[VHDL编程multi

说明:实现带时钟的四比特正数相加,一个顶层文件和一个tb文件-4 bit multiply
<王一> 在 2025-01-20 上传 | 大小:1kb | 下载:0

[VHDL编程EDA-clock

说明:基于FPGA的时钟设计,主要能实现计时和日历功能-The clock design based on FPGA, the main can realize clock and calendar function
<林盛> 在 2025-01-20 上传 | 大小:809kb | 下载:0

[VHDL编程Sum

说明:实现加法器功能的简单verilog代码,可以为初学者提供学习。-Achieve a simple verilog adder function code can provide learning for the beginners.
<Jersey> 在 2025-01-20 上传 | 大小:17kb | 下载:0

[VHDL编程BASYS2

说明:xilinx公司basy2开发板入门教程.-xilinx development board company basy2 Tutorial.
<伍卅> 在 2025-01-20 上传 | 大小:6.88mb | 下载:0

[VHDL编程iis

说明:I2S RTLs 很好的程序,已经成功通过验证和测试-I2S verilog RTLs, very easy to read
<liwei039> 在 2025-01-20 上传 | 大小:15kb | 下载:0

[VHDL编程Frame_Detection

说明:OFDM系统的帧检测模块,根据802.11a标准,利用前导的相关性进行的设计,综合仿真及在线调试已通过。-Ofdm fr a me detection module is very important and verilog difficult to realize in OFDM system.
<2375788> 在 2025-01-20 上传 | 大小:7.61mb | 下载:0

[VHDL编程PSG

说明:Altera NIOS II 使用的 AY-3-8910 模組 . 包含 AY-3-8910 Verilog code, SOPC builder使用的hw_tcl及R-2R DAC 電路-AY-3-8910 module for Altera Nios II. verilog source code, hw_tcl file and R-2R DAC schematic.
<charlie> 在 2025-01-20 上传 | 大小:45kb | 下载:0
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