[VHDL编程] Dm9000a_Init

说明：DM9000网口通信芯片控制模块，基于FPGA的控制模块，实现初始化，数据发送接收-The DM9000 network port communications chip control module, FPGA-based control module initialization, sending and receiving data
<姜新洲> 在 2025-02-06 上传 | 大小：24.21mb | 下载：0

[VHDL编程] vga_pic_70

说明：VGA控制程序，光栅图像选择性输出，主要是VGA的控制-VGA control program, a raster image of the selective output, mainly the control of the VGA
<姜新洲> 在 2025-02-06 上传 | 大小：4.58mb | 下载：0

[VHDL编程] sdram_48LC16M16A

说明：48LC16M16A型SDRAM芯片的FPGA控制器程序-48LC16M16A SDRAM chip FPGA controller program
<姜新洲> 在 2025-02-06 上传 | 大小：2.85mb | 下载：0

[VHDL编程] QPSK_R

说明：QPSK的FPGA实现，QPSK的调制实现-FPGA implementation of QPSK QPSK modulation to achieve
<姜新洲> 在 2025-02-06 上传 | 大小：13.3mb | 下载：0

[VHDL编程] QPSK_T

说明：QPSK解调器的FPGA实现，VERILOG源码-FPGA implementation of QPSK demodulator，VERILOG source
<姜新洲> 在 2025-02-06 上传 | 大小：3.88mb | 下载：0

[VHDL编程] AD976_6channel

说明：软件是适用于FPGA的VHDL程序，目的是用于满足IEC61850－9协议的电子式互感器采样，软件采用的是AD976芯片，能同时进行6个通道的采样。-The software is based on vhdl for FPGA,which is used for electronic transformer fulfil IEC6185-9 protocol.the AD chip is AD976,it works at the st
<cjp> 在 2025-02-06 上传 | 大小：15kb | 下载：0

[VHDL编程] mu_12channel

说明：适用于IEC61850-9-1的合并单元的程序（VHDL），12个通道。-The software is developed for merging unit under IEC61850-9-1 protocol,12 channels.
<cjp> 在 2025-02-06 上传 | 大小：324kb | 下载：0

[VHDL编程] Xilinx_Workshop-Design_Primer

说明：Xilinx 大学计划Professor Workshops系列课程-Xilinx Workshop FPGA Digital System Design Primer one
<zhibo_zhu> 在 2025-02-06 上传 | 大小：5.51mb | 下载：0

[VHDL编程] divfreq

说明：利用vhdl语言,说明分频程序的工作原理与流程,并结合led进行显示说明其分频效果.-tell us how to divide frequency from main signals via vhdl,and combine with leds to show us detailed information.
<Youngsun chao> 在 2025-02-06 上传 | 大小：180kb | 下载：0

[VHDL编程] beep

说明：利用vhdl语言控制蜂鸣器发出指定频率的音律.-by means of vhdl ,to tell us how to control beeper to produce designated frequencies sounds.
<Youngsun chao> 在 2025-02-06 上传 | 大小：193kb | 下载：0

[VHDL编程] counter

说明：利用vhdl语言实现从0到99的记数功能,并在数码管上进行显示-using vhdl,to count from 0 to 99 and show them on the digital tube.
<Youngsun chao> 在 2025-02-06 上传 | 大小：196kb | 下载：0

[VHDL编程] counter

说明：A 4 bit counter. In the testbench I combine three counters into one. Verilog codes with testbench.
<cry> 在 2025-02-06 上传 | 大小：1kb | 下载：0