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[VHDL编程] lab13
说明:Quartus实现单周期处理器,利用verilog语言-verilog cpu design<chengshanbo> 在 2025-03-01 上传 | 大小:885kb | 下载:0
[VHDL编程] iNEMO-UART-Output
说明:意法半导体的惯性传感器套件iNEMO通过串口数据数据的固件,通过J-LINK下载至开发板-iNEMO Toolkit firmwire by ST Ltd. (Data output from UART)<刘艺> 在 2025-03-01 上传 | 大小:144kb | 下载:0