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[VHDL编程] convolution_encoder_VHDL
说明:卷积码编译码,由SERVICE、PSDU、TAIL和PAD域组成的DATA域应进行卷积编码,码率应根据所需的传输速率从R=1/2,2/3,3/4中选择-for 802.11a simulation WLAN FEC convolution_encoder g0=133 g1=171 Rate 0:1/2 1:2/3 2:3/4 for 802.11a simulation<cslbetter> 在 2025-02-26 上传 | 大小:124kb | 下载:0
[VHDL编程] verilog_pingpang
说明:verilog 语言的写的乒乓操作,通过两个寄存器实现。-verilog language, written in ping-pang operation, achieved through two registers.<世海> 在 2025-02-26 上传 | 大小:1kb | 下载:0
[VHDL编程] hello_world
说明:FPGA SOPC设计的uart串口 NIOS II中的程序 自己亲自做的 在串口调试工具中成功调试-FOGA SOPC UART NIOS II<宋冬锋> 在 2025-02-26 上传 | 大小:2kb | 下载:0
[VHDL编程] Verilog_HDL_
说明:Verilog HDL华为入门教程,简单易懂,对初学者来说很好的一个教程-Verilog HDL<张金梅> 在 2025-02-26 上传 | 大小:257kb | 下载:0
[VHDL编程] Baseband_line_code
说明:基于VHDL语言的基带线路码产生电路设计(毕业论文),内涵完整的源代码-Based on VHDL language baseband line code generation circuit design (Thesis), meaning the complete source code<tanisaber> 在 2025-02-26 上传 | 大小:667kb | 下载:0