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[VHDL编程fifo

说明:此程序为存储器常用的FIFO(先入先出),程序中没有指明位宽,这样更适合于初学者进行套用-This process commonly used for the memory FIFO (FIFO), the procedure is not specified bit, so more suitable for beginners to apply
<zhaohongliang> 在 2025-01-19 上传 | 大小:1kb | 下载:0

[VHDL编程32-bit_multiplier_model

说明:此程序为32-bit乘法器,另附有VHDL测试程序-This procedure for 32-bit multiplier, followed VHDL test procedures
<zhaohongliang> 在 2025-01-19 上传 | 大小:2kb | 下载:0

[VHDL编程FPGA

说明:fpga 设计经典指导原则,非常经典,对于深入理解FPGA设计方法有很好的帮助-FPGA design of the guiding principles of the classic, very classic, for better understanding of FPGA design methods have a very good help
<zjc> 在 2025-01-19 上传 | 大小:254kb | 下载:0

[VHDL编程VHDL

说明:一个实现整数分频的VHDL代码,只要把n设置成你所需要的分频的数值就行-A realization of an integer divider of the VHDL code, as long as the n set you need the sub-frequency values on the line
<褚如龙> 在 2025-01-19 上传 | 大小:1kb | 下载:0

[VHDL编程mux21a

说明:二选一多路选择开关,实现对信号的采集,分类。-Second, the election more than one way selector switch, to achieve signal acquisition, classification.
<weigong> 在 2025-01-19 上传 | 大小:103kb | 下载:0

[VHDL编程chuankou

说明:串口VHDL实现 -Serial Serial VHDL realization of VHDL
<cheng> 在 2025-01-19 上传 | 大小:2kb | 下载:0

[VHDL编程8ENCODE

说明:8位优先编码器 verilog CPLD EPM1270 源代码-8-bit priority encoder verilog CPLDEPM1270 source code
<韩思贤> 在 2025-01-19 上传 | 大小:110kb | 下载:0

[VHDL编程MULT

说明:乘法器 verilog CPLD EPM1270 源代码-Multiplier verilog CPLDEPM1270 source code
<韩思贤> 在 2025-01-19 上传 | 大小:108kb | 下载:0

[VHDL编程div

说明:除法器实验 verilog CPLD EPM1270 源代码-Experimental divider verilog CPLDEPM1270 source code
<韩思贤> 在 2025-01-19 上传 | 大小:115kb | 下载:0

[VHDL编程mux

说明:多路选择器 verilog CPLD EPM1270 源代码-MUX source verilog CPLDEPM1270
<韩思贤> 在 2025-01-19 上传 | 大小:105kb | 下载:0

[VHDL编程traffic

说明:模拟交通灯 verilog CPLD EPM1270 源代码-Simulation of traffic lights verilog CPLDEPM1270 source code
<韩思贤> 在 2025-01-19 上传 | 大小:187kb | 下载:0

[VHDL编程UART

说明:串口实验,很好用,我还有verilog HDL VHDL CPLD EPM1270 源代码-Serial experiments, very good, and I still have the source code verilog HDLVHDL CPLDEPM1270
<韩思贤> 在 2025-01-19 上传 | 大小:331kb | 下载:0
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