[VHDL编程] CPU

说明：使用verilog作为CPU设计语言实现单数据通路五级流水线的CPU。具有32个通用寄存器、一个程序计数器PC、一个标志寄存器FLAG，一个堆栈寄存器STACK。存储器寻址粒度为字节。数据存储以32位字对准。采用32位定长指令格式，采用Load/Store结构，ALU指令采用三地址格式。支持有符号和无符号整数加、减、乘、除运算，并支持浮点数加、减、乘、除四种运算，支持与、或、异或、非4种逻辑运算，支持逻辑左移、逻辑右移、算术右移、循环右
<haotianr> 在 2024-11-19 上传 | 大小：42kb | 下载：0

[VHDL编程] seg

说明：自己做的开发板，基于epm7064slc44-10控制数码管显示0-F。有助于初学者学习。-To do their own development board, based on the control epm7064slc44-10 digital tube display 0-F. Help beginners to learn.
<杨少栋> 在 2024-11-19 上传 | 大小：223kb | 下载：0

[VHDL编程] clockVHDL

说明：利用VHDL语言设计的数字钟,能进行正常的时、分、秒计时功能，分别由6个数码管显示24h、60min、60s-The use of VHDL language design digital clock, can be a normal hour, minute, second timing function, respectively, by 6 digital tube display 24h, 60min, 60s
<可爱> 在 2024-11-19 上传 | 大小：143kb | 下载：0

[VHDL编程] FPGA_design_handbook

说明：FPGA设计的指导性原则是一本FPGA设计的指导手册-FPGA design is the guiding principle of an FPGA design guide
<郭明> 在 2024-11-19 上传 | 大小：2.04mb | 下载：0

[VHDL编程] dac0832_VHDL

说明：用Verilog HDL编写的0832源程序，实现对0832实现D/A转换。也可方便地转换为vhdl源程序。-Prepared by using Verilog HDL source code 0832, 0832 to achieve the realization of D/A conversion. Also can be easily converted to VHDL source code.
<楼夏岚> 在 2024-11-19 上传 | 大小：57kb | 下载：0

[VHDL编程] UART_send

说明：Verilog HDL 串口发送程序，在ACTEL Fusion FPGA上实验成功 ，和大家一起分享！^_^-Verilog HDL send serial procedures, ACTEL Fusion FPGA in the success of the experiment, and share with everyone! ^ _ ^
<whq> 在 2024-11-19 上传 | 大小：1kb | 下载：0

[VHDL编程] UART_rec

说明：verilog 串口接收程序，在ACTEL Fusion FPGA上实验成功 和大家一起分享！^_^-Verilog serial receive process, ACTEL Fusion FPGA in the experimental success and share with everyone! ^ _ ^
<whq> 在 2024-11-19 上传 | 大小：1kb | 下载：0

[VHDL编程] scorce

说明：FPGA驱动1602LCD程序，在实验板上实验成功，和大家分享！^_^-FPGA-driven 1602LCD procedures, the success of the experiment on-board experiments, and the U.S. to share! ^ _ ^
<whq> 在 2024-11-19 上传 | 大小：2kb | 下载：0

[VHDL编程] seethefunctiondescribe

说明：FPGA中双向端口IO的研究.pdf。 和大家分享！^_^-FPGA in the study of bi-directional IO port. Pdf. And everyone to share! ^ _ ^
<whq> 在 2024-11-19 上传 | 大小：113kb | 下载：0

[VHDL编程] chengxu

说明：信号测量 实时显示 延时2秒 键盘扫描-Signal measurement in real-time display the keyboard scanning delay 2 seconds
<丁涛> 在 2024-11-19 上传 | 大小：25kb | 下载：0

[VHDL编程] UP3_CLOCK

说明：在UP3开发板上已经验证过的VHDL代码。 精确到十分之一秒，具有闹钟，整点报时， 时间可重新设置等功能，在LCD1602上显示。 绝对推荐，比网上其他类似代码功能要全而且经过验证。-In the UP3 development board has been verified VHDL code. Accurate to one-tenth of seconds, with the alarm clock, the whol
<kehan> 在 2024-11-19 上传 | 大小：711kb | 下载：0

[VHDL编程] sine

说明：chdl 64位计数器，利用mif格式文件产生正弦波。可以在fpga模拟正弦波-chdl 64 bit counter, using sine wave generated mif format. Sine wave can be simulated in FPGA
<yyqdian> 在 2024-11-19 上传 | 大小：262kb | 下载：0