[VHDL编程] ISE_lab15

说明：以前的xilinx公司的软件的FPGA的实验程序-FPGA experimental program xilinx company s previous software
<郑> 在 2025-02-08 上传 | 大小：1.97mb | 下载：0

[VHDL编程] ISE_lab16

说明：FPGA experimental program xilinx company s previous software -FPGA experimental program xilinx company s previous software
<郑> 在 2025-02-08 上传 | 大小：472kb | 下载：0

[VHDL编程] ISE_lab17

说明：FPGA experimental program xilinx company s previous software -FPGA experimental program xilinx company s previous software
<郑> 在 2025-02-08 上传 | 大小：2.57mb | 下载：0

[VHDL编程] ISE_lab18

说明：FPGA experimental program xilinx company s previous software -FPGA experimental program xilinx company s previous software
<郑> 在 2025-02-08 上传 | 大小：4.67mb | 下载：0

[VHDL编程] detector

说明：序列检测器，实验题第一题，懂的人都懂得，可以实现对1101的检测，使用状态机-Sequence detector
<zdg> 在 2025-02-08 上传 | 大小：418kb | 下载：0

[VHDL编程] RAM_FIFO

说明：双向fifo,但只能实现只读或者只写，同步读写在时序上很难做出好的设计和判断-bidirectional fifo
<zdg> 在 2025-02-08 上传 | 大小：471kb | 下载：0

[VHDL编程] divide

说明：实现带符号位的除法，使用二进制的左移处理，属于第三个大作业，懂的人都懂得-signed divide
<zdg> 在 2025-02-08 上传 | 大小：3.43mb | 下载：0

[VHDL编程] work1

说明：简单的3三八译码器实现，通过vhdl语言实现，6.0下编译仿真通过-Simple 3 thirty-eight of decoder achieved by vhdl language 6.0 compiler through simulation
<李奇杰> 在 2025-02-08 上传 | 大小：174kb | 下载：0

[VHDL编程] risc_cpu_619

说明：使用verilog语言在fpga上搭建简单的risc_cpu，在cyclone上已经验证-risc_cpu ,verilog ,have passd
<uodsi> 在 2025-02-08 上传 | 大小：136kb | 下载：0

[VHDL编程] lcd

说明：实现12864lcd显示自己的学号，每个字为16X16格式。-Achieve 12864lcd show their student number, each word 16X16 format.
<单车少年> 在 2025-02-08 上传 | 大小：91kb | 下载：0

[VHDL编程] final

说明：一个32位的cpu设计，实际是verilog语言，只不过pudn上没有verilog的选项，希望能对你有帮助-this is a 32 bit cpu designer project,which use verilog language. Hope it could help u.
<novice> 在 2025-02-08 上传 | 大小：557kb | 下载：0

[VHDL编程] lkl

说明：用门电路搭起来的13进制计数器，在7的时候有一个灯显示，初次提交，不对不处请指教-13 binary counter, gate ride up at 7 when a light display, the initial submission, please enlighten wrong not at
<luhao> 在 2025-02-08 上传 | 大小：284kb | 下载：0