[VHDL编程] traffic

说明：完整的VerilogHDL交通灯例程，已通过硬件仿真。-VerilogHDL complete routine traffic lights, had passed through hardware emulation.
<xuping> 在 2025-01-12 上传 | 大小：34kb | 下载：0

[VHDL编程] clock

说明：完整的VerilogHDL时钟例程，已通过硬件仿真。-VerilogHDL complete clock routines, has passed through hardware emulation.
<xuping> 在 2025-01-12 上传 | 大小：28kb | 下载：0

[VHDL编程] serial

说明：VerilogHDL例程，实现和PC机进行基本的串口通信。-VerilogHDL routine, and realize the basic PC-to serial communication.
<xuping> 在 2025-01-12 上传 | 大小：66kb | 下载：0

[VHDL编程] dividefre

说明：CPLD_EPM7064程序,运用计数器实现的分频程序,VHDL-CPLD_EPM7064 procedures, the use of counters to achieve the sub-frequency procedures, VHDL
<> 在 2025-01-12 上传 | 大小：124kb | 下载：0

[VHDL编程] ss_pcm.tar

说明：pcm 接口的源代码，有参考价值~verilog语言编写-pcm interface source code, have reference value ~ verilog language
<张丰> 在 2025-01-12 上传 | 大小：4kb | 下载：1

[VHDL编程] LCD1602_B

说明：关于1602的液晶显示驱动程序，不过如果直接用的话可能不行，不同的型号要做一定的修改。-About 1602 of the liquid crystal display driver, but if the direct use of the words may not do, the different models to do some modifications.
<贾晓东> 在 2025-01-12 上传 | 大小：1kb | 下载：0

[VHDL编程] 8051core

说明：基于vhdl的51内核的程序设计，可以进行编译，稍微修改就可以成为自己订制的软cpu.-VHDL-based 51-core programming, can be compiled, a slight modification can become their own customized soft cpu.
<贾晓东> 在 2025-01-12 上传 | 大小：1.09mb | 下载：0

[VHDL编程] simple_cpu

说明：自己定制自己的cpu，一个比较简单的cpu。熟悉处理器制作流程。-Customize their own cpu, a relatively simple cpu. Familiar with the production flow processor.
<贾晓东> 在 2025-01-12 上传 | 大小：550kb | 下载：0

[VHDL编程] fsm8051

说明：：首先介绍了DS--UWB系统的的发射与接收模型，然后分析了利用滑动相关法对信道进行估讣，并巾此给出 了不同RAKE接收机RAKE合成权系数选取方案。对接收机采用最大比(MRC)、最小均方误差(MM SE)及带均衡 器的(MRC)合并系数选取的误码性能进行了仿真和对比。结果表明了带均衡器的MRC—RAKE只用较少的分支 就可以达到接收性能明显优于MMSE—RAKE的程度。尤其在信噪比比较大时。这种优势更加明显。-: Firs
<季昀> 在 2025-01-12 上传 | 大小：1kb | 下载：1

[VHDL编程] oc8051_defines

说明：：首先介绍了DS--UWB系统的的发射与接收模型，然后分析了利用滑动相关法对信道进行估讣，并巾此给出 了不同RAKE接收机RAKE合成权系数选取方案。对接收机采用最大比(MRC)、最小均方误差(MM SE)及带均衡 器的(MRC)合并系数选取的误码性能进行了仿真和对比。结果表明了带均衡器的MRC—RAKE只用较少的分支 就可以达到接收性能明显优于MMSE—RAKE的程度。尤其在信噪比比较大时。这种优势更加明显。-: Firs
<季昀> 在 2025-01-12 上传 | 大小：4kb | 下载：0

[VHDL编程] pc

说明：：首先介绍了DS--UWB系统的的发射与接收模型，然后分析了利用滑动相关法对信道进行估讣，并巾此给出 了不同RAKE接收机RAKE合成权系数选取方案。对接收机采用最大比(MRC)、最小均方误差(MM SE)及带均衡 器的(MRC)合并系数选取的误码性能进行了仿真和对比。结果表明了带均衡器的MRC—RAKE只用较少的分支 就可以达到接收性能明显优于MMSE—RAKE的程度。尤其在信噪比比较大时。这种优势更加明显。-: Firs
<季昀> 在 2025-01-12 上传 | 大小：1kb | 下载：0

[VHDL编程] currentRAM

说明：通用存储器代码,一个典型的通用存储器的代码,希望对大家有所帮助-General memory code, a typical general-purpose memory of the code, and they hope to help everyone
<wx> 在 2025-01-12 上传 | 大小：1kb | 下载：0