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[VHDL编程VH_SYN

说明:标准电视信号的同步生成程序,利用VHDL和原理图,利用Quartus综合-Standard television signal to generate the synchronization procedures, the use of VHDL and schematic diagram, using Quartus integrated
<蔡有才> 在 2024-11-16 上传 | 大小:89kb | 下载:0

[VHDL编程FIFO

说明:异步FIFO控制器的Verilog设计与实现-Asynchronous FIFO controller Verilog Design and Implementation
<陈晨> 在 2024-11-16 上传 | 大小:5kb | 下载:0

[VHDL编程8251Verilog

说明:通用串行异步收发器8251的Verilog HDL源代码,经过仿真验证。 -Universal Serial Asynchronous Receiver Transmitter 8251 the Verilog HDL source code, through simulation.
<钟兵> 在 2024-11-16 上传 | 大小:15kb | 下载:0

[VHDL编程clock

说明:fpga clock 设计,资料较好,供大家参考,非商用目的哦-fpga clock design, the information is better, for your reference, non-commercial purposes Oh
<max> 在 2024-11-16 上传 | 大小:2kb | 下载:0

[VHDL编程Verilog

说明:本书是一本Verilog语言设计和综合手册,对学习Verilog语言有很大作用,值得阅读.
<刘晓琴> 在 2024-11-16 上传 | 大小:1.64mb | 下载:1

[VHDL编程lab5_VHDL

说明:VHDL源码 VHDL源码 -VHDL source VHDL source VHDL source
<baiyanru> 在 2024-11-16 上传 | 大小:6kb | 下载:0

[VHDL编程DDRSDRAM

说明:DDR sdram 包含的完整的源码,仿真的相关文件-DDR sdram contains complete source code, simulation of the relevant documents
<飞翔> 在 2024-11-16 上传 | 大小:998kb | 下载:0

[VHDL编程FIFO-DC

说明:FIFO的Verilog程序 已在modelsim中编译通过 并且可以通过DC进行综合-FIFO procedures have been in the Verilog in ModelSim compiler and can be passed through the integrated DC
<liujl> 在 2024-11-16 上传 | 大小:59kb | 下载:0

[VHDL编程shipingkonzhi

说明:用VHDL实现视频控制程序,实现对图像的采集和压缩,-Using VHDL realize video control procedures, to achieve image acquisition and compression,
<张龙> 在 2024-11-16 上传 | 大小:421kb | 下载:0

[VHDL编程wishbone2avalone

说明:由avalen总线转接i2c总线的vhdl程序 可应用于nios嵌入式系统-By avalen bus adapter i2c bus VHDL program can be applied to Nios Embedded Systems
<yeyoushi> 在 2024-11-16 上传 | 大小:417kb | 下载:0

[VHDL编程ddr

说明:ISE MIG1.6 生成的DDR SDRAM控制器代码(含TESHBENCH)
<yuling> 在 2024-11-16 上传 | 大小:999kb | 下载:0

[VHDL编程foudiv

说明:可以实现对任意波形分任意频,分频加减通过按键实现。-Can be achieved for any arbitrary waveform at frequency, frequency addition and subtraction through the keys to achieve.
<莱密> 在 2024-11-16 上传 | 大小:212kb | 下载:0
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