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ChainCascade_src
- ChainCascade， harr 特征进行分类器训练，得到一个级联的boosted分类器，训练目标特征，检测物体，这是从opencv库 转化成 vc++源代码，有一位博士完成，很不错。-ChainCascade, Harr features classifier training to be a cascade boosted classifier, training objectives features, object dete
2Tx_2Rx_STBC_MAP
- 该文件夹为空时块码－卷积码级联系统的仿真程序，天线配置为2发2收。 主要程序的用途说明： mainMIMO_OFDMA_2Tx_Convcode.m: 主程序，设置各种参数 gendatabits.m: 生成原始信息比特数据的程序 conv_encoder.m: 卷积码编码器 interleave.m: 交织器 mod_2Tx_STBC_DFUSC_Convcode.m：调制程序 gen_SUI_CorrCI
ChainCascade_src
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2Tx_2Rx_STBC_MAP
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haarcascade
- 利用级联的HAAR分类器寻找检测目标，采用OPENCV编写，代码简单运行稳定-Use the haar classifier cascade testing to find the target, using OPENCV preparation, code simple and stable operation
haar
- 利用级联的Haar分类其寻找检测目标。核心函数cvHaarDetectObjects使用针对某目标物体的级联分类器在图像中找到包含目标物体的矩形区域，并将这些区域作为一系列的矩形框返回。-Haar cascade classification using its search for target detection. CvHaarDetectObjects core function for a target object using
Ababoostdemo
- ababoost级联分类器,通过一组弱分类器形成一个强分类器-cascade of classification
cd4094
- 用51单片机 实现cd4094 移位寄存器的控制，写得很简洁，易懂。-Cd4094 with 51 single-chip realization of the control shift register, write a very simple, easy to understand.
83390078DDS
- DDS的工作原理是以数控振荡器的方式产生频率、相位可控制的正弦波。电路一般包括基准时钟、频率累加器、相位累加器、幅度/相位转换电路、D/A转换器和低通滤波器（LPF）。频率累加器对输入信号进行累加运算，产生频率控制数据X（frequency data或相位步进量）。相位累加器由N位全加器和N位累加寄存器级联而成，对代表频率的2进制码进行累加运算，是典型的反馈电路，产生累加结果Y。幅度/相位转换电路实质上是一个波形寄存器，以供查表使用。读
zishiyingxianbo
- 利用自适应陷波器来消除通信系统中的工频干扰。重点从LMS算法的步长因子、信号与干扰的频率差、参考输入的幅值和相位等几个方面讨论单频陷波器的滤波效果。另外，还以双频为例，讨论了多频级联型陷波器的特性，证实了经过两次滤波后，信号可被真实的恢复出来，且误差收敛趋于稳定。-The use of adaptive notch filter to eliminate the communication system frequency interf
49636992ciccomp
- 级联积分－梳状(Cascaded Integrator–Comb，CIC)滤波器，是种高 效滤波器。它是一种线形相位FIR滤波器，由工作在高抽样率的级联理 想积分器和低抽样率的级联微分器组成,根据抗混叠和抗镜像的指标 确定所需的级联数目。 -Cascaded integrator- comb (Cascaded Integrator-Comb, CIC) filter, is the kind of high effic
svpwm3level
- 三电平级联npc逆变器的空间矢量调制的matlab仿真策略-3-level npc inverter svpwm model
cpspwm_loopA4
- 基于TMS320F2812设计的单相五电平级联逆变器的全部工程文件。- A design of single-phase five level cascaded inverter TMS320F2812-based ,including all the project files.
86verilog
- 以FPGA 芯片为平台构建了数字信号滤波实时处理模块, 给出了 50Hz 陷波器的切比雪夫Ê 型 IIR 数字 滤波器 4 阶级联的结构, 提出了对滤波器系数量化的逼近方法, 完成了基于 FPGA 的陷波器实现, 并成功地实现了 对含有工频 50Hz 噪声干扰的心电信号的滤波处理, 通过与M at lab 计算所得到的滤波处理效果进行比较分析, 结 果表明: 基于FPGA 采用切比雪夫Ê 型 4 级级联结
vehicle_detection
- vehicle_detection 的相关代码，供大家参考，haar 级联器-dode for vehicle_detection，used for reference
haarcascades
- 各种级联器，用于人脸识别，超级好用，欢迎下载。(Various cascaded devices are used in face recognition)
74ls138级联
- 很多朋友不知道138译码器如何级联，如何编程，这里在 proteus 8仿真下做的测试，包含接线图和程序，可测试(Many friends do not know how the 138 decoder cascade, how to program, here in the Proteus 8 simulation to do the test, including wiring diagrams and procedures, ca
bin
- 载波相移调制策略下的H桥级联型多电平逆变器的MATLAB仿真(H bridge cascaded multilevel inverter under carrier phase shift modulation strategy)
four_levelH_bridg
- 四电平H桥级联多电平逆变器模型，基于载波移相原理(The four level H bridge cascaded multilevel inverter model is based on the carrier phase shifting principle.)
Hseries_7Level_Inverter_No1
- 七电平逆变器的Simulink模型，调制方式采用SPWM方式，拓扑为H桥级联。(The Simulink model of Seven-level inverters adopts SPWM modulation mode and H-bridge cascade topology.)