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文件名称:adder-VerilogHDL

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 3kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 王**
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

各种加法器的VerilogHDL语言编写的包括普通加法器，串行进位加法器，超前进位加法器等-Adder VerilogHDL various languages, including ordinary adder, serial carry adder, CLA, etc.
相关搜索： verilogHDL

(系统自动生成,下载前可以参看下载内容)

下载文件列表

新建文件夹2\adder8.v

...........\adder8.v.bak

...........\adder8_2.v

...........\adder8_2.v.bak

...........\Advance_carry_adder.v

...........\carry_skip_adder.v

...........\serial_carry_adder.v

新建文件夹2

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