文件名称:CoreCFI
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VERILOG编写的CoreCFI实验例程，包括整个工程，可以直接使用-Prepared CoreCFI VERILOG test routines, including the whole project, can be used directly
(系统自动生成,下载前可以参看下载内容)
下载文件列表
CoreCFI实验\CoreCFI\assert.log
...........\.......\CoreCFI.prj
...........\.......\coreconsole\common\CORECFI\CORECFI.cxf
...........\.......\...........\......\.......\coreparameters.v
...........\.......\...........\......\.......\mti\lib_vlog_obs\CORECFI_LIB\@c@f@i_@f@l@a@s@h\verilog.psm
...........\.......\...........\......\.......\...\............\...........\.................\_primary.dat
...........\.......\...........\......\.......\...\............\...........\.................\_primary.vhd
...........\.......\...........\......\.......\...\............\...........\...o@r@e@c@f@i\verilog.psm
...........\.......\...........\......\.......\...\............\...........\..............\_primary.dat
...........\.......\...........\......\.......\...\............\...........\..............\_primary.vhd
...........\.......\...........\......\.......\...\............\...........\..............@r@e@a@l\verilog.psm
...........\.......\...........\......\.......\...\............\...........\......................\_primary.dat
...........\.......\...........\......\.......\...\............\...........\......................\_primary.vhd
...........\.......\...........\......\.......\...\............\...........\corecfi_chip\verilog.psm
...........\.......\...........\......\.......\...\............\...........\............\_primary.dat
...........\.......\...........\......\.......\...\............\...........\............\_primary.vhd
...........\.......\...........\......\.......\...\............\...........\........usertb\verilog.psm
...........\.......\...........\......\.......\...\............\...........\..............\_primary.dat
...........\.......\...........\......\.......\...\............\...........\..............\_primary.vhd
...........\.......\...........\......\.......\...\............\...........\_info
...........\.......\...........\......\.......\...\scripts\wave_usertb.do
...........\.......\...........\......\.......\rtl\vlog\cfi_flash\CFI_FLASH.mem
...........\.......\...........\......\.......\...\....\.ore_obfuscated\corecfi.v
...........\.......\...........\......\.......\...\....\...............\corecfireal.v
...........\.......\...........\......\.......\...\....\test\user\corecfi_chip.v
...........\.......\...........\......\.......\...\....\....\....\corecfi_query.mem
...........\.......\...........\......\.......\...\....\....\....\corecfi_usertb.v
...........\.......\...........\Core_CFI\Core_CFI.cci
...........\.......\...........\........\core_cfi.cco
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...........\.......\...........\........\Core_CFI.v
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...........\.......\...........\........\Core_CFI.xml
...........\.......\...........\........\........_CORECFI\Core_CFI_CORECFI.xml
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...........\.......\...........\........\testbench.vhd
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