文件名称:DDS
- 所属分类:
- 其他嵌入式/单片机内容
- 资源属性:
- [WORD]
- 上传时间:
- 2012-11-26
- 文件大小:
- 4kb
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- 柏**
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Verilog语言实现基于DDS技术的余弦信号发生器,输出位宽16Bit-Verilog language technology based on the cosine DDS signal generator, the output bit width 16Bit
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