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文件名称:RS_204_188_decoder

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 14kb
  • 下载次数：
  • 0次
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修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

使用verilog完成了RS编码的设计，编码参数为输入188，输出204-The use of Verilog coding RS completed the design, coding parameters for the importation of 188, the output 204
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verilog

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文件名大小更新时间
第23章 RS(204188)译码器的设计
..............................\BM_KES.v
..............................\CheinSearch.v
..............................\ff_mul.v
..............................\forney.v
..............................\ROM_INV.mif
..............................\rom_inv.v
..............................\rom_power.mif
..............................\rom_power.v
..............................\RS(204188)译码器说明.txt
..............................\rs_decoder.v
..............................\SyndromeCalc.v

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