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文件名称:clock

  • 所属分类：
  • 汇编语言
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 7kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 谢**
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

数字钟的verilog程序，很经典，大家可以看看。-Verilog digital clock procedures, it is a classic, we will look at.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

clock

.....\clock.bsf

.....\clock.v

.....\db

.....\..\xgh.db_info

.....\..\xgh.eco.cdb

.....\..\xgh.map.qmsg

.....\..\xgh.sld_design_entry.sci

.....\xgh.bdf

.....\xgh.done

.....\xgh.qpf

.....\xgh.qsf

.....\xgh.qws

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