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文件名称:verilog

  • 所属分类：
  • 加密解密
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 11kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • z**
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

用于aes128加密的扩展密钥算法，比较详细-For the expansion of key aes128 encryption algorithm, a more detailed
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aes128
verilog

(系统自动生成,下载前可以参看下载内容)

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aes_cipher_top.v

aes_inv_cipher_top.v

aes_inv_sbox.v

aes_key_expand_128.v

aes_rcon.v

aes_sbox.v

timescale.v

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