文件名称:an487_design_example
介绍说明－－下载内容均来自于网络，请自行研究使用
用verlog hdl开发的SPI 的源码-Verlog hdl use the source code developed by SPI
(系统自动生成,下载前可以参看下载内容)
下载文件列表
SPI_to_I2S_Altera_MAX_II_CPLD_Design_Example
............................................\code
............................................\....\spi_to_i2s.v
............................................\modelsim
............................................\........\spi_to_i2s.cr.mti
............................................\........\spi_to_i2s.mpf
............................................\........\spi_to_i2s.v
............................................\........\SPI_to_I2S_test.v
............................................\........\vsim.wlf
............................................\........\wave.do
............................................\........\work
............................................\........\....\@s@p@i_to_@i2@s_test
............................................\........\....\....................\verilog.psm
............................................\........\....\....................\_primary.dat
............................................\........\....\....................\_primary.vhd
............................................\........\....\i2s_master
............................................\........\....\..........\verilog.psm
............................................\........\....\..........\_primary.dat
............................................\........\....\..........\_primary.vhd
............................................\........\....\spi_slave
............................................\........\....\.........\verilog.psm
............................................\........\....\.........\_primary.dat
............................................\........\....\.........\_primary.vhd
............................................\........\....\spi_to_i2s
............................................\........\....\..........\verilog.psm
............................................\........\....\..........\_primary.dat
............................................\........\....\..........\_primary.vhd
............................................\........\....\_info
............................................\quartus
............................................\.......\db
............................................\.......\..\spi_to_i2s.asm.qmsg
............................................\.......\..\spi_to_i2s.asm_labs.ddb
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