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文件名称:clock2001

  • 所属分类：
  • Static控件
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 1kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • dan***
  • 相关连接：
  • 无
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  • 别用迅雷下载，失败请重下，重下不扣分！
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失败请重下，重下不扣分。
修正介绍说明

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时钟模块之一：二进制转BCD码verilog源代码FPGA advantage编程环境-clock module : BCD switch binary source code Verilog FPGA advantage programming environment
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