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文件名称:verilog-example

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [Text]
  • 上传时间：
  • 2013-01-18
  • 文件大小：
  • 4kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 吴**
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  • 无
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修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

verilog基础实验，包括篮球计数器，序列检测计等-verilog based experiments, including basketball counter sequence detector
(系统自动生成,下载前可以参看下载内容)

下载文件列表





4位加减法源程序.txt

两个三位数相乘.txt

两个三位数相乘管脚分配.txt

两个四位加减法管脚.txt

序列检测及.txt

序列检测计管脚.txt

按键扫描显示.txt

点阵显示.txt

点阵显示管脚分配.txt

篮球30秒计数器.txt

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