文件名称:verilog-example
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(系统自动生成,下载前可以参看下载内容)
下载文件列表
序列检测器\seq.v
移位器\shift.v
4位并行乘法器\mult.v
...超前加法器\adder_4.v
ALU\adder_32.v
...\adder_4.v
...\alu.v
...\shift.v
计数器\counter.v
滤波器\fir.v
全加器\adder.v
......\adder_4.v
序列检测器
移位器
4位并行乘法器
4位超前加法器
ALU
计数器
滤波器
全加器
移位器\shift.v
4位并行乘法器\mult.v
...超前加法器\adder_4.v
ALU\adder_32.v
...\adder_4.v
...\alu.v
...\shift.v
计数器\counter.v
滤波器\fir.v
全加器\adder.v
......\adder_4.v
序列检测器
移位器
4位并行乘法器
4位超前加法器
ALU
计数器
滤波器
全加器