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文件名称:adder

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • 上传时间：
  • 2013-01-02
  • 文件大小：
  • 5kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 吴**
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

VHDL语言编写，在实验箱上实现加法器的仿真，可行-VHDL language adder simulation experiment box, feasible
(系统自动生成,下载前可以参看下载内容)

下载文件列表





adder\aa (2).done

.....\aa.done

.....\aa.qpf

.....\aa.qsf

.....\aa.qws

.....\aa.vhd

.....\aa.vhd.bak

.....\db\aa.analyze_file.qmsg

.....\..\aa.db_info

.....\..\aa.eco.cdb

.....\..\aa.sld_design_entry.sci

.....\..\prev_cmp_aa.qmsg

.....\db

adder

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