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文件名称:adder

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 156kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 赵*
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
下载
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如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

一个加法器程序,同时里面又有一个测试程序，是学习verilog HDL的好程序。-a adder program
(系统自动生成,下载前可以参看下载内容)

下载文件列表

adder\adder.cr.mti

.....\vsim.wlf

.....\adder.v

.....\adder_testbench.do

.....\adder_testbench.v

.....\transcript

.....\adder.mpf

.....\chart\Thumbs.db

.....\.....\图1-3.bmp

.....\.....\图1-4.bmp

.....\.....\图1-5.bmp

.....\.....\图1-6.bmp

.....\.....\图1-7.bmp

.....\.....\图1-8.bmp

.....\chart

adder

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