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[VHDL编程] quanzixongxiyiji-verilod
说明:根据日常生活中的洗衣机使用流程设计状态。 空闲——加水——洗涤——排水——加水——清洗排水——甩干——报警 - according to the processes and the use of washing machine in the daily life of the design state. Idle-------- washing water drainage water------ alarm dry<mousejohn> 在 2025-02-04 上传 | 大小:1kb | 下载:0
[VHDL编程] 20140306mii
说明:在digilent公司genesys开发板上,使用temac ip核实现了10/100M网口的驱动。-Implementation of a driver for 10M/100M ethernet communication on GENESYS form digilent.<黄悦> 在 2025-02-04 上传 | 大小:6.54mb | 下载:0
[VHDL编程] ALU-and-Register-File
说明:ALU&Register Files(RF)之實現和其資料路徑的組合,包含了(1)ALU(2)Register File (RF)(3)Serial-in parallel-out register file(4)ALU + RF datapath-To learn the Verilog design for ALU and Register Files which are two main building blocks of a<sara kuo> 在 2025-02-04 上传 | 大小:6kb | 下载:0
[VHDL编程] Finite-State-Machines
说明:此壓縮檔包含四個資料夾(1)Moore Machine(2)Mealy Machine(3)Memory(4)A mini system,學習如何以階層化的方法去撰寫系統內部的小工作區塊,並了解迷你CPU內部的記憶體簡單的運作情形&資料串流-design the finite state machine and the mini system.<sara kuo> 在 2025-02-04 上传 | 大小:10kb | 下载:0