[VHDL编程] u_channel_correction

说明：基于FPGA的通道不一致性校正的verilog代码-FPGA-based channel inconsistency correction verilog code
<pingfulong> 在 2025-02-01 上传 | 大小：1kb | 下载：0

[VHDL编程] hdlc

说明：HDLC通信协议，FPGA实现，包含源文件和仿真测试文件。-HDLC comunication
<lirui> 在 2025-02-01 上传 | 大小：347kb | 下载：0

[VHDL编程] frequency_division

说明：三分频电路是硬件工程师招聘中必考题目，看似简单却能够挂到很多人，这里给出三分频的VHDL设计，其他奇数分频电路均可以参考此分频设计。其中并附有简单的偶数分频设计-Here are three points frequency VHDL design, other odd points frequency circuit can refer to this crossover design.
<lirui> 在 2025-02-01 上传 | 大小：4kb | 下载：0

[VHDL编程] decoder_3_8

说明：对于初学FPGA者，需要掌握各种编码、译码，这里给出3-8译码的VHDL设计代码。-For the beginner to the FPGA, need to master all kinds of coding, decoding, presented here 3-8 decoding VHDL design code.
<lirui> 在 2025-02-01 上传 | 大小：2kb | 下载：0

[VHDL编程] uart

说明：串口通信时初学FPGA者必须要掌握的基础知识，这里给出了UART通信的VHDL代码，以及仿真测试文件。-A serial port communication beginner to must master the basic knowledge of FPGA, UART communication VHDL code is given here, and the simulation test files
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[VHDL编程] 20140825

说明：FPGA设计在设计过程中使用ISE软件自带的IP核时，消耗资源太大的时候，需要自己编写滤波器的源代码，这里给出我们常用的串行FIR核的verilog语言代码设计文件，并通过作者时序仿真验证，并用于实际的项目中。-The FPGA design in the design process of ISE software used to own the IP core, consume resources is too big, need
<lirui> 在 2025-02-01 上传 | 大小：5.29mb | 下载：0

[VHDL编程] FIR

说明：FPGA设计在设计过程中使用ISE软件自带的IP核时，消耗资源太大的时候，需要自己编写滤波器的源代码，这里给出我们常用的串行FIR核的verilog语言代码设计文件，并通过作者时序仿真验证，并用于实际的项目中。-The FPGA design in the design process of ISE software used to own the IP core, consume resources is too big, need
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[VHDL编程] gray2bin

说明：格雷码转二进制 格雷码转二进制-Transfer binary Gray code binary Gray code switch
<wcc> 在 2025-02-01 上传 | 大小：1kb | 下载：0

[VHDL编程] digital_demo

说明：数码管扫描驱动，用Verilog编写，采用模块化思想-digital tube scan driver writen by verilog,using the thought of module
<george ma> 在 2025-02-01 上传 | 大小：6kb | 下载：0

[VHDL编程] water_led

说明：led流水灯，使用Verilog编程，使用模块化思想-water_led,use verilog language and the thought of module
<george ma> 在 2025-02-01 上传 | 大小：391kb | 下载：0

[VHDL编程] flash_and_water

说明：闪耀和流水灯并行，使用Verilog语言-Flash and water led,run at the same time,using verilog language
<george ma> 在 2025-02-01 上传 | 大小：126kb | 下载：0

[VHDL编程] Experiment03

说明：这个功能是按键消抖，通过模块化的建模思想来编程的-This feature is key debounce, modular modeling idea to programming
<george ma> 在 2025-02-01 上传 | 大小：122kb | 下载：0