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[VHDL编程] altera_1c12_test
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[VHDL编程] freq_divide_100
说明:基于VHDL的分频计数设计,针对ED2开发板分配引脚-Frequency count based on VHDL<ziyang> 在 2024-11-19 上传 | 大小:239kb | 下载:0