[VHDL编程] read_solomon

说明：This project implements a parameterized Reed Solomon decoder for use in OFDM wireless systems.
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[VHDL编程] cfft

说明：The FFT architecture is pipelined on a rank basis each rank has its own butterfly and ranks are isolated from each other using memory interleavers.-The FFT architecture is pipelined on a rank basis each rank has
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[VHDL编程] BasicDES

说明：The BasicDES Cryptography Core is a small, fast implementation of the DES-56 encryption standard.
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[VHDL编程] GUNMAOJI

说明：全自动伺服驱动压销滚铆plc程序，日本进口的滚铆机原码-PLC
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[VHDL编程] Twister_DDR_SDRAM_Board_Manual

说明：Twister DDR EP1C6Q240 FPGA 开发板 原理图，PCB,BOM-Twister Board Documentation Schematics, PCB and BOM Rev. B
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[VHDL编程] turbocodes_latest.tar

说明：turbo encode and decoder
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[VHDL编程] t1

说明：tourbo encode pdf file we can study derive these folders
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[VHDL编程] arm9_fpga2_verilog

说明：arm9 FPGA VERILOG 代码-arm9 FPGA VERILOG code
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[VHDL编程] EnergyEfficientVLSIArchitectureforLinearTurboEqua

说明：Energy efficient for turbo encoder decoder
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[VHDL编程] IterativeDecodingofBinary

说明：In this paper, energy efficient VLSI architectures for linear turbo equalization are studied. Linear turbo equalizers exhibit dramatic bit error rate (BER) improvement over conventional equalizers by enabling a form of
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[VHDL编程] MapAlgorithm

说明：However, turbo equalizers can be computationally complex and hence require significant power consumption. In this paper, we present an energy-efficient VLSI architecture for such linear turbo equalizers. Key architectu
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[VHDL编程] RECURSIVEALGORITHMFOREFFICIENTMAPDECODING

说明：Early termination enables powering down parts of the soft-input soft-output (SISO) equalizer and decoder thereby saving power.
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