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[VHDL编程] 3-8Decoder
说明:二进制译码器只显示0,1。十进制译码器显示0-9、显示译码器显示0—F-Show only 0,1 binary decoder. Showing 0-9 decimal decoder, display decoder display 0-F<袁欢> 在 2025-03-02 上传 | 大小:25kb | 下载:0
[VHDL编程] 8-3encoder
说明:二进制译码器只显示0,1。十进制译码器显示0-9、显示译码器显示0—F -Show only 0,1 binary decoder. Showing 0-9 decimal decoder, display decoder display 0-F<袁欢> 在 2025-03-02 上传 | 大小:26kb | 下载:0
[VHDL编程] 100jinzhijishuqi
说明:1) 计数器的时钟输入信号为1S (2)计数器的功能是从0到99计数,以十进制形式显示 (3)有一个复位端clr和两个控制端plus和minus,在这些控制信号的作用下,计数器具有复位、增或减计数、暂停功能。 -1) counter clock input signal for the 1S (2) function of the counter counts from 0 to 99, shown in decimal<袁欢> 在 2025-03-02 上传 | 大小:69kb | 下载:0
[VHDL编程] EDAkejian5
说明: 本文给出了采用这些技术的高速环境状态机设计的规范及分析方法和优化方法,并给出了相应的示例。 -In this paper, high-speed environments using these technologies state machine design specifications and methods of analysis and optimization methods, and the correspondi<袁欢> 在 2025-03-02 上传 | 大小:627kb | 下载:0
[VHDL编程] ads7809
说明:ADS7809是Burr-Brown公司推出的高精度AD采集芯片。它采用5V单电源供电,内含16位 逐次逼近寄存器,采样精度高,功耗小。 用Verilog实现其配置-ADS7809 is a Burr-Brown Introduces High Precision AD capture chip. It uses a single 5V supply, with 16-bit successive approximation r<dengxiaosong> 在 2025-03-02 上传 | 大小:1kb | 下载:0
[VHDL编程] ad5399
说明:AD5399是一款串行输入、双通道、12位数模转换器,可采用二进制补码数字编码。。 用Verilog实现其配置与功能-AD5399 is a serial input, dual-channel, 12-bit DAC, digital code can be twos complement. . Configuration and use Verilog functions to achieve its<dengxiaosong> 在 2025-03-02 上传 | 大小:1kb | 下载:0
[VHDL编程] lcd1602_drive
说明:用Verilog实现1602的配置及功能。正确编译与实现-Realized by Verilog 1602 configurations and functions. Compilation and implementation of the right<dengxiaosong> 在 2025-03-02 上传 | 大小:1kb | 下载:0
[VHDL编程] config_ad9957
说明:用Verilog正确配置ad9957,,在ISE环境中正确编译与实现-Properly configured with the Verilog ad9957,, compiled in the ISE environment and realization of the right<dengxiaosong> 在 2025-03-02 上传 | 大小:1kb | 下载:0
[VHDL编程] config_ad6636
说明:用Verilog正确配置ad6636,,在ISE环境中正确编译与实现-Properly configured with the Verilog ad6636,, compiled in the ISE environment and realization of the right<dengxiaosong> 在 2025-03-02 上传 | 大小:1kb | 下载:0
[VHDL编程] floating-point-adder
说明:verilog implementation of the floating point adder<ramtin> 在 2025-03-02 上传 | 大小:2kb | 下载:0