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[VHDL编程LCD-Digital-voltmeter

说明:数字电压表的基本工作原理是利用A/D转换电路将待测的模拟信号转换成数字信号,通过相应换算后将测试结果以数字形式显示出来的一种电压表。较之于一般的模拟电压表,数字电压表具有精度高、测量准确、读数直观、使用方便等优点。-Digital voltmeter the basic working principle is to use A/D converter circuit to test the analog signals into di
<任林> 在 2025-04-22 上传 | 大小:137kb | 下载:0

[VHDL编程Verilog-HDL

说明:a dvan let go look ing down hello how are you today
<nghia> 在 2025-04-22 上传 | 大小:4.81mb | 下载:0

[VHDL编程Based-on-FPGA-and-DSP-lpr

说明:基于FPGA和DSP的车牌识别系统的硬件设计与实现-Based on FPGA and DSP license plate identification system hardware design and implementation
<sunbo> 在 2025-04-22 上传 | 大小:1.58mb | 下载:0

[VHDL编程inverse_counter

说明:利用ALTERA的DE2实现4位可逆计数器,并进行7段译码显示,VHDL编写-4-bit counter with 7-segment display using VHDL
<梁清凯> 在 2025-04-22 上传 | 大小:1kb | 下载:0

[VHDL编程verilog

说明:一些常用verilog代码实例,包含组合逻辑电路,时序逻辑电路,和一些复杂电路模块-Some commonly used verilog code examples.Contains the assembly logic circuit, temporal logic circuit, and some complex circuit module
<杨宏伟> 在 2025-04-22 上传 | 大小:50kb | 下载:0

[VHDL编程DDSKeyAndLcd

说明:基于SPCE061A的DDS 步进20Hz,两路输出,相位差可调,频率可到20多K,加上低通滤波,效果还不错.完全达到03年,电赛"相位测量仪"发挥部分波形发生器的要求. 程序中,频率初始值,相位差初始值通过键盘输入,液晶是KS0108的驱动芯片,如果液晶不一致,需要做相应的调整.-DDS base on SPCE061A
<> 在 2025-04-22 上传 | 大小:79kb | 下载:0

[VHDL编程digital-clock

说明:设计一个 24 h 制数字时钟,要求能显示时、分、秒,并可手动调整时和分。-Design a 24 h the digital clock, requirement can shows, minutes and seconds, and can when manual adjustment and points.
<chuchu> 在 2025-04-22 上传 | 大小:76kb | 下载:0

[VHDL编程BIT1625-spec

说明:一款不错的解码器芯片,可以直接驱动TFT LCD显示屏-VIDIO ENCODER
<杜辉> 在 2025-04-22 上传 | 大小:923kb | 下载:0

[VHDL编程8-lights-the-controller-design

说明:八路彩灯控制器的设计.数字钟的主体是计数器,它记录并显示接受到的秒脉冲个数,其中秒和分为模 60 计数器,小时为模 24 计数器,分别产生 2 位 BCD 码-8 lights the controller design.A digital clock are the subject of counter, it recorded and display to receive the number of second pulse, in
<chuchu> 在 2025-04-22 上传 | 大小:74kb | 下载:0

[VHDL编程bcd7seg

说明:bcd to 7-segment decoder
<kilhyun> 在 2025-04-22 上传 | 大小:1kb | 下载:0

[VHDL编程digitalclk

说明:用maxplus编写的时钟程序。包括天、时、分、秒-make use of language of maxplus to make a clock.include day,hour,minute,second
<文艺成> 在 2025-04-22 上传 | 大小:369kb | 下载:0

[VHDL编程vhdl--eda

说明:m 序列发生器 计数器 七段数码管显示 bcd 十六进制转换-failed to translate
<kuwait> 在 2025-04-22 上传 | 大小:2kb | 下载:0
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