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[VHDL编程add

说明:一个用quartus原理图输入的全加器,(A full adder with quartus schematic input,)
<zhangning194 > 在 2024-11-16 上传 | 大小:1kb | 下载:0

[VHDL编程交通信号灯

说明:模拟十字路口红绿灯简单功能,附有倒计时功能,有仿真文件。(Simulated traffic signal lamp.)
<蜻鬼 > 在 2024-11-16 上传 | 大小:1.41mb | 下载:0

[VHDL编程uart

说明:实现与电脑端串行数据发送与接收,波特率为9600(Realize serial data sending and receiving with the computer terminal)
<hurricanhup > 在 2024-11-16 上传 | 大小:1kb | 下载:0

[VHDL编程AdlER

说明:some thing is very off about this
<Benten > 在 2024-11-16 上传 | 大小:4.93mb | 下载:0

[VHDL编程spram

说明:verilog编写的spram,包含顶层模块,控制模块和spram本体,其中spram为Altera提供的ip核,已在quartus 16上运行通过(Verilog written in spram, including the top-level module, control module and spram ontology, where spram is the IP kernel provided by Altera, has
<keykai > 在 2024-11-16 上传 | 大小:2.73mb | 下载:0

[VHDL编程bist 2017 paper

说明:A new low-power (LP) scan-based built-in selftest (BIST) technique is proposed based on weighted pseudorandom test pattern generation and reseeding. A new LP scan architecture is proposed, which supports both pseudora
<Maddy619 > 在 2024-11-16 上传 | 大小:1.5mb | 下载:0

[VHDL编程spec.tar

说明:M.2 testing specification
<isaac172106 > 在 2024-11-16 上传 | 大小:444kb | 下载:0

[VHDL编程tengkan-V2.2

说明:Calculation crosshairs diffraction image at different distances, Channelized receiver based on multi-phase structure, Verification is available.
<manjaofienen > 在 2024-11-16 上传 | 大小:148kb | 下载:0

[VHDL编程hhcit

说明:Includes the modulation, demodulation, signal to noise ratio calculation, Including AHP, factor analysis, regression analysis, cluster analysis, Noisy pulse correlation detection signal.
<张海涛 > 在 2024-11-16 上传 | 大小:148kb | 下载:0

[VHDL编程vtrb

说明:% disp('MATLAB encoder output') % disp(u)
<Ravin48 > 在 2024-11-16 上传 | 大小:165kb | 下载:0

[VHDL编程basic_uart

说明:basic code for UART receiver and transmeter
<Ravin48 > 在 2024-11-16 上传 | 大小:3kb | 下载:0

[VHDL编程RS232_verilog1

说明:RS232通信协议verilog程序。经过调试可以使用(RS232 communication protocol Verilog program. After debugging can be used)
<你好PSL > 在 2024-11-16 上传 | 大小:6.38mb | 下载:0
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