资源列表
[VHDL编程] Principles-of-Verifiable-RTL-Design
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[VHDL编程] uart2bus_latest
说明:用于fpga并口连接的工程哈,请大家支持一下-For fpga parallel port connection works Kazakhstan, support for what<sun> 在 2025-01-27 上传 | 大小:1.15mb | 下载:0
[VHDL编程] ISCAS85aISCAS89
说明:Verilig of ISCAS85 and ISCAS89<wangnant> 在 2025-01-27 上传 | 大小:1.16mb | 下载:0
[VHDL编程] Drivers_USB_TELIUM-PC
说明:usb ingenico driver EFT930 for win xp<kira> 在 2025-01-27 上传 | 大小:1.16mb | 下载:0
[VHDL编程] SegSimplified
说明:本工程使用verilog HDL和vivado2014集成开发环境实现利用xilinx Basys3开发板上4位数码管显示从0到9999的计数器功能。-This project uses verilog HDL to realise counting 0 to 9999 on the 7-seg LED loaded on Xilinx Basys3 board.<姚罡> 在 2025-01-27 上传 | 大小:1.15mb | 下载:0