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[VHDL编程dds

说明:一个可用的很不错的DDS 频率合成程序,用VHDL语言编写-Available is a good DDS frequency synthesis procedures, using VHDL language
<七步> 在 2025-02-01 上传 | 大小:1.02mb | 下载:0

[VHDL编程extension_pack_latest.tar

说明:This project contains files you can use to expand upon the basic IEEE packages you normally use for creating testbenches and RTL code.
<mahmoud> 在 2025-02-01 上传 | 大小:1.02mb | 下载:0

[VHDL编程edacounter

说明:用VHDL语言编写的计数器,在板子上运行成功,可以循环计数,加减计数,先置数后计数等-Counter with the VHDL language, in the board to run successfully, you can cycle counting, addition and subtraction counting, numbers, counting the first home
<fana> 在 2025-02-01 上传 | 大小:1.02mb | 下载:0

[VHDL编程testRAMWR

说明:这是一个用VHDL编写的读写双口RAM的程序.-This is a work written in VHDL to read and write dual-port RAM program.
<chenye> 在 2025-02-01 上传 | 大小:1.02mb | 下载:0

[VHDL编程digitalsystemdesign

说明:非常经典的FPGA设计PPT,北航夏宇闻老师讲义-FPGA designs are very classic PPT, Beihang XIA Yu-Wen teacher handouts
<张鹏> 在 2025-02-01 上传 | 大小:1.02mb | 下载:0

[VHDL编程jibenrenwu1

说明:一个用vhdl语言写的简单输出正弦波的程序,适用于初学者-Vhdl language used to write a simple sine wave output of the program, for beginners
<alice> 在 2025-02-01 上传 | 大小:1.02mb | 下载:0

[VHDL编程multiply_shift_add

说明:基于移位相加运算的乘法器设计,multiply_shift_add中包含了完整的设计工程文件,可在Xilinx ISE中运行-Adding operation based on shift on time-multiplier design, multiply_shift_add contains the complete design engineering documents, Xilinx ISE in running
<chenlan> 在 2025-02-01 上传 | 大小:1.02mb | 下载:0

[VHDL编程FFT288

说明:本部分是128点的fft,经过了modelsim的仿真验证.里面采用了华莱士树等结构,整体结构采用2-It is 128 point fft,which has been verificated in the modelsim.In the verilog code ,we use hulaishi tree.we use 288 architecture to complete it.
<gaod> 在 2025-02-01 上传 | 大小:1.02mb | 下载:0

[VHDL编程.tranfervw

说明:一款可以生成.vwf的小软件 对编写verilog语言很有用-a software for vwf file of verilog code programming
<贺铮> 在 2025-02-01 上传 | 大小:1.02mb | 下载:0

[VHDL编程ICC_

说明:用FPGA实现了对IIC器件AT24C02的读写操作。系统上电后先读取AT24C02内部的数据,然后不断写入改变的新数据,数据的变化显示在数码管上。-The operation of reading and writing the IIC device AT24C02 by FPGA has been come true.When the system powered on FPGA reads the internal data of
<王方秋> 在 2025-02-01 上传 | 大小:1.02mb | 下载:0

[VHDL编程dingceng

说明:简单的地铁售票系统,可以实现1元,2元,5元投币,自选票数-Simple subway ticketing system that can achieve 1 yuan, 2 yuan, 5 yuan coin, optional Votes
<沫沫> 在 2025-02-01 上传 | 大小:1.02mb | 下载:0

[VHDL编程shizhong

说明:在Quartus II 环境下利用Verilog语言编写的时钟程序,包含模块化器件和仿真波形-In the Quartus II environment, use Verilog language clock procedures, including modular devices and simulation waveforms
<daijunyu> 在 2025-02-01 上传 | 大小:1.02mb | 下载:0
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