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[VHDL编程Quartus7.2_crack

说明:qutartusII7.2的破解工具。之不过是在6.0的基础上,但是可以用。-qutartusII7.2 the crack tool. It is based on the 6.0, but can be used.
<guobo> 在 2025-02-10 上传 | 大小:530kb | 下载:0

[VHDL编程rs232_rec5

说明:VHDL语言实现的穿行通讯,可实现闭环操作,通讯过程中每个bit位采样3次,保证数据准确。-VHDL language achieved through communication, can realize the closed-loop operation, communication process each bit digital sampling 3 times to ensure accurate data.
<> 在 2025-02-10 上传 | 大小:529kb | 下载:0

[VHDL编程sdram_test

说明:FPGA测试程序,使用XC3S250E对SDRAM进行读写的测试程序,SDRAM使用的是HY57V281620, 大小为128M。-FPGA test procedure, the use of XC3S250E SDRAM read and write on the test procedure, SDRAM using HY57V281620, size of 128M.
<gq> 在 2025-02-10 上传 | 大小:529kb | 下载:0

[VHDL编程DDS_FSK

说明:该软件能实现FSK的调制功能,在quartusII上进行了仿真,效果非常好-The software enables the FSK modulation capabilities, in quartusII on the simulation results is very good
<yangfeng> 在 2025-02-10 上传 | 大小:529kb | 下载:0

[VHDL编程7ENT1003_Lecture5

说明:this is basic of vhdl.
<ajay> 在 2025-02-10 上传 | 大小:529kb | 下载:0

[VHDL编程eetop[1].cn_vga

说明:一个模拟视频输入转VGA视频输出的Verilog程序,经过验证-vga verilog code,already pass
<杨永> 在 2025-02-10 上传 | 大小:529kb | 下载:0

[VHDL编程transmit

说明:基于ALTERA EP2C8的多通道窄脉冲产生VHDL代码,能够实现窄脉冲驱动信号。-ALTERA EP2C8-based multi-channel narrow pulse generated VHDL code can narrow pulse drive signal.
<霍赞> 在 2025-02-10 上传 | 大小:529kb | 下载:0

[VHDL编程automatic_washing_machine

说明:自动洗衣机控制器,为不同的洗衣阶段设置不同的时间。全自动洗衣机有9个工作状态:空闲(idle),第一次加水(water1),洗涤(wash),第一次排水(drain1),第二次加水(water2),漂洗(rinse),第二次排水(drein2),甩干(dry),响起音乐(music)。-Automatic washing machine controller , for the different washing stages of s
<x5675602> 在 2025-02-10 上传 | 大小:529kb | 下载:0

[VHDL编程verilog

说明:《verilog_数字系统设计课程》(第二版)思考题答案-" Verilog_ Digital System Design Course" (Second Edition) Questions answers. Rar
<李群> 在 2025-02-10 上传 | 大小:529kb | 下载:0

[VHDL编程DA_TLC5615_breath-led

说明:使用10位串行DA芯片TLC5615将数字信号转换为模拟信号,开发板DA芯片VDD=5V,VREF=3.3V 计算公式:Vout=VREF*(N/1024) N为10位二进制码 ** 操作过程:根据需求,在程序改变10位二进制数,在DA芯片的Vout脚输出相应电压-breath led
<作家> 在 2025-02-10 上传 | 大小:529kb | 下载:0

[VHDL编程encoder_clk

说明:精确实现奇数分频,将FPGA开发板提供的25MHZ时钟分频为1MHZ,内含测试文件(Accurate realization of odd frequency division, the FPGA development board provides 25MHZ clock frequency divided into 1MHZ, containing test files)
<没伞的孩子 > 在 2025-02-10 上传 | 大小:528kb | 下载:0

[VHDL编程scg_seg

说明:led灯循环依次点亮,共11位数字,从右到左依次亮(The LED lights are lit in turn, with 11 digits from right to left.)
<程序员的今日> 在 2025-02-10 上传 | 大小:529kb | 下载:0
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