[VHDL编程] SDRAM_96M

说明：基于FPGA的SDRAM串口实验，verilog语言写的，附件里是做实验的工程，连上串口，下进去就有数据了，波特率9600，一个停止位，SDRAM时钟是96MHz，数据时FPGA自动产生的，正确输出结果是00到FF递增一，再循环。这个工程警告比较少，基本是故意为之的警告，时序也已经收敛。-FPGA-based SDRAM serial experiments, verilog language written annex is to d
<Grace> 在 2025-04-09 上传 | 大小：5.33mb | 下载：0

[VHDL编程] UART-botelv115200

说明：基于FPGA的串口收发程序，波特率115200，亲测，可用。-FPGA-based serial transceiver procedures, 115200 baud rate, pro-test, can be used.
<Grace> 在 2025-04-09 上传 | 大小：2.27mb | 下载：0

[VHDL编程] MUX41

说明：四选一的选择器 FPGA源码，包括模块Verilog文件和测试testbench文件-Four one of the selector FPGA source code, including the module Verilog files and test testbench files
<JJ> 在 2025-04-09 上传 | 大小：112kb | 下载：0

[VHDL编程] ADDR

说明：8位全加器，包括半加器verilog文件，全加器verilog文件，8位全加器verilog文件，和8位全加器测试testbench文件-8 full adder, including half adder, full adder Verilog file, Verilog file, 8 full adder Verilog files, and 8 full adder test testbench file
<JJ> 在 2025-04-09 上传 | 大小：138kb | 下载：0

[VHDL编程] cnt2

说明：16位二进制计数器及设计代码其测试代码（vhdl）-16-bit binary counter and design codes and test code (vhdl)
<cassy> 在 2025-04-09 上传 | 大小：2kb | 下载：0

[VHDL编程] FPGA_phase_lock_demodulation

说明：FPGA 用Verilog语言实现数字锁相解调系统，包含了正交的DDS函数发生器和相应的AD驱动-FPGA digital demodulation system in Verilog lock, comprising a DDS orthogonal function generator and driving the corresponding AD
<gdres> 在 2025-04-09 上传 | 大小：45.32mb | 下载：0

[VHDL编程] verilogsram

说明：SRAM 读写实验，SRAM存储器的读写操作，Verilog源码有助于提高代码coding能力。使用例程。-SRAM write and read
<曹振吉> 在 2025-04-09 上传 | 大小：81kb | 下载：0

[VHDL编程] verilogiic1121

说明：IIC通信Verilog源码，基于FPGA的IIC时序，有助提高对串行通信的认识。-IIC communication
<cao_sir> 在 2025-04-09 上传 | 大小：464kb | 下载：0

[VHDL编程] fft

说明：快速傅里叶变换用verilog语言写的模块，，可以从中可以得到点思路-Fast Fourier transform verilog module, the experiment is available, you can get some ideas
<徐林> 在 2025-04-09 上传 | 大小：2kb | 下载：0

[VHDL编程] iprecieve

说明：udp协议的ipreceive模块，用verilog写的，思路很明确-Udp agreement ipreceive module, written with verilog, the idea is clear
<徐林> 在 2025-04-09 上传 | 大小：2kb | 下载：0

[VHDL编程] uarttx

说明：fpga板 verilog写的串口发送数据的模块，主要可以看下思路，也是可用的-Fpga board verilog write serial port to send data module, the main can look at ideas, is also available
<徐林> 在 2025-04-09 上传 | 大小：1kb | 下载：0

[VHDL编程] SOPC_LED

说明：在FPGA上建立一个简单的SOPC系统，实现LED演示功能(Building a simple SOPC system on FPGA,Implementation of LED demo function.)
<surseaman> 在 2025-04-09 上传 | 大小：2.7mb | 下载：0