[VHDL编程] Verilog-examples

说明：verilog 例程，白金手册，很多实用例程，加法器，循环编码器-verilog routines, platinum manual, many utility routines, adder, cycle coding and more
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[VHDL编程] SpW_codec_perfect

说明：SpaceWire 编解码器完整验证，vhdl源程序，-SpaceWire compile a complete verification of decoder, VHDL source code,
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[VHDL编程] spacewire_latest.tar

说明：SpaceWire接口，vhdl源程序，完整验证-SpaceWire interface, VHDL source code, the complete validation
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[VHDL编程] 01-NEC_1997_B

说明：简易数字频率计（1997年B题）,本例程的rst(复位)键位于拨码开关的第1位(最右边),高电平有效。-Simple digital frequency meter Problem B (1997), the routine rst (reset) button is located in one of the DIP switch (far right), high effective.
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[VHDL编程] 02-NEC_1999_B

说明：数字有效值电压表（1999年B题）,本例程的rst(复位)键位于拨码开关的第1位(最右边),高电平有效。-Digital rms voltmeter Problem B (1999), the routine rst (reset) button is located in one of the DIP switch (far right), active high.
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[VHDL编程] 03-NEC_2003_C

说明：移相信号发生器（2003年C题），verilog源程序，-Phase shift generator Problem C (2003), Verilog source code,
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[VHDL编程] 04-NEC_2003_C

说明：数字相位测量仪（2003年C题），verilog源程序-digital phase meter Problem C (2003), Verilog source code
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[VHDL编程] 05-NEC_2003_D

说明：简易逻辑分析仪（2003年D题），verilog源程序-Simple logic analyzer (, 2003 D), Verilog source code
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[VHDL编程] 06-NEC_2005_A

说明：06-正弦信号发生器（2005年A题），verilog源程序-06- sinusoidal signal generator (2005 A question), Verilog source code
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[VHDL编程] alarm

说明：The red arrow showed the output became 8 when the measured temperature changed to 11°C. As shown by black arrow, the maximum output was 28. The program was run according to the proposed method.
<jayjay> 在 2025-04-24 上传 | 大小：99kb | 下载：0

[VHDL编程] comp

说明：The red arrow showed the output became 8 when the measured temperature changed to 11°C. As shown by black arrow, the maximum output was 28. The program was run according to the proposed method.
<jayjay> 在 2025-04-24 上传 | 大小：112kb | 下载：0

[VHDL编程] 8.3-LCD

说明：FPGA驱动LCD显示中文字符程序及状态机的使用-FPGA to drive the LCD display Chinese characters procedures and the use of the state machine
<林高办> 在 2025-04-24 上传 | 大小：5kb | 下载：0