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[VHDL编程] cml
说明:基于Verilog的数字基带通信系统 3. 项目描述:本系统为通信原理课程设计课题之一,用Verilog语言编写数字基带通信系统的应用程序,完成P=31的m序列的生成,并进行HDB3编码传输,在接收端进行译码接收。-Verilog-based digital baseband communication system 3. Project Descr iption: The system is one of the topics C<chengmengli> 在 2025-02-07 上传 | 大小:248kb | 下载:0
[VHDL编程] 8bitprocessor
说明:用简单函数实现八位处理器的fpga程序 用vhdl语言编写 quartus环境实现-With the function to achieve eight-processor fpga program<PETER> 在 2025-02-07 上传 | 大小:216kb | 下载:0
[VHDL编程] ECE200_LAB4
说明:Control unit for DLX processor<Raj Parihar> 在 2025-02-07 上传 | 大小:55kb | 下载:0