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[VHDL编程] Edge_Detection
说明:信号的边缘检测,把一个频率较低的信号转为索需要的时钟频率的信号-Edge detection signal, the low-frequency signal into a signal cable required clock frequency<商不起> 在 2024-11-17 上传 | 大小:1kb | 下载:0
[VHDL编程] d_latch
说明:d latch digital circuits vhdl<Efe Emre Pazarli> 在 2024-11-17 上传 | 大小:1.12mb | 下载:0
[VHDL编程] four_bit_adder
说明:four bit adder digital circuits vhdl<Efe Emre Pazarli> 在 2024-11-17 上传 | 大小:459kb | 下载:0
[VHDL编程] boomshakalaka
说明:Verilog实现数字钟,超多功能,移位显示,闹钟设置,移位设置时间,定时秒表,控制LED记录数值等-Verilog digital clock, ultra-versatile, shift display, alarm settings, set the time shift, the timing stopwatch, and other numerical control LED record<wangruiqi> 在 2024-11-17 上传 | 大小:1.77mb | 下载:0
[VHDL编程] osd_grayscale
说明:HDMI显示,显示灰阶,网上的资料大多是VGA的,我这里是HDMI的!!!虽然没啥不一样... 显示复杂的灰阶-HDMI display, gray scale display, online information mostly VGA, and I have here is the HDMI! ! ! Although nothing is not the same gray-scale display complex ...<wangruiqi> 在 2024-11-17 上传 | 大小:237kb | 下载:0
[VHDL编程] vga
说明:Link the VGA adapter located in the altera DE2board to a monitor<nisal senarathne> 在 2024-11-17 上传 | 大小:695kb | 下载:0
[VHDL编程] spi_module
说明:使用FPGA编辑Verilog语言来实现控制SPI,完成SPI时序,并在该时序下实现数据的传输和接收。-FPGA and SPI<gxb> 在 2024-11-17 上传 | 大小:1kb | 下载:0
[VHDL编程] i2c_latest.tar
说明:可综合iic从机模块,通过modelsim仿真-Synthesizable iic slave module.Modelsim simulation passed.<yxd> 在 2024-11-17 上传 | 大小:1.41mb | 下载:0