[VHDL编程] e8

说明：清华大学电子系 数字钟设计实验报告（第8个实验）-Tsinghua University, Department of Electronics, digital clock design lab report (Article 8 experiments)
<夏冬> 在 2024-11-18 上传 | 大小：3.32mb | 下载：0

[VHDL编程] e10

说明：清华大学电子工程系 帧同步器设计实验报告 起始状态定为失步态，通过帧同步码来判断帧的正确性。判断正确则进入预同步态。然后再连续判断两次帧同步码，正确则进入同步态。如果随后的帧的帧头是错误的，则进入保持态以防误码造成的错误。只有在连续发现三次帧头错误才返回失步态。-Electronic Engineering, Tsinghua University, fr a me synchronizer design experiments s
<夏冬> 在 2024-11-18 上传 | 大小：2.46mb | 下载：0

[VHDL编程] e12HDB3

说明：清华大学电子工程系 HDB3实验报告 包括：M序列发生器，编码器，解码器-Electronic Engineering, Tsinghua University HDB3 lab report include: M sequence generator, encoders, decoders
<夏冬> 在 2024-11-18 上传 | 大小：5.66mb | 下载：0

[VHDL编程] ug871_vivad_HLS_tutorial

说明：Xilinx Vivado HLS 高层次综合工具的软件使用说明-Vivado HLS Xilinx high level integrated tool for the use of software instructions
<taxue4485> 在 2024-11-18 上传 | 大小：7.41mb | 下载：0

[VHDL编程] clk_generator

说明：时钟分频的verilog代码，能够实现小数分频，文件为Xilinx ISE工程文件-Frequency clock divider verilog codes, it is possible to achieve fractional file to Xilinx ISE Project Files
<duzengquan> 在 2024-11-18 上传 | 大小：381kb | 下载：0

[VHDL编程] absolute2relative_coding

说明：ISE编程仿真DPSK中相对码和绝对码的转换-DPSK code conversion relative and absolute code
<sxx> 在 2024-11-18 上传 | 大小：2.13mb | 下载：0

[VHDL编程] squa

说明：Verilog语言ISE下实现方波产生和占空比调节-ISE Verilog language implementations under wave generator
<sxx> 在 2024-11-18 上传 | 大小：3.07mb | 下载：0

[VHDL编程] counter6display

说明：ISE环境下Verilog变成实现六位计数器并用7段显像管显示-ISE Verilog environment becomes realized under six counter with 7-segment display CRT
<sxx> 在 2024-11-18 上传 | 大小：175kb | 下载：0

[VHDL编程] coubter_key

说明：ISE环境下Verilog编程实现机械按键去抖-ISE Verilog programming environment under mechanical debounces
<sxx> 在 2024-11-18 上传 | 大小：431kb | 下载：0

[VHDL编程] cnt63dis

说明：ISE环境下Verilog编程实现63进制计数器并用7段译码显像管显示-ISE Verilog programming environment under 63 binary counter with 7 segment decoder CRT display
<sxx> 在 2024-11-18 上传 | 大小：1.19mb | 下载：0

[VHDL编程] addafilter

说明：基于NIOSii的数字滤波器，包括AD和DA的读取输出部分，包括C语言源码和verilog源工程-digital filter based on Nios2
<胡哲哲> 在 2024-11-18 上传 | 大小：26.84mb | 下载：0

[VHDL编程] digitron

说明：数码管显示，里面包含了译码器等多用电路的源码和顶层电路图，并最后进行了组合。-Digital display, which contains the source code and many other top level schematics decoder circuit and finally a combination.
<木子> 在 2024-11-18 上传 | 大小：460kb | 下载：0