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[VHDL编程] ug871_vivad_HLS_tutorial
说明:Xilinx Vivado HLS 高层次综合工具的软件使用说明-Vivado HLS Xilinx high level integrated tool for the use of software instructions<taxue4485> 在 2024-10-15 上传 | 大小:7773184 | 下载:0
[VHDL编程] clk_generator
说明:时钟分频的verilog代码,能够实现小数分频,文件为Xilinx ISE工程文件-Frequency clock divider verilog codes, it is possible to achieve fractional file to Xilinx ISE Project Files<duzengquan> 在 2024-10-15 上传 | 大小:390144 | 下载:0