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[VHDL编程crc

说明:用于ethernet的CRC校验源代码,ALTERA官方代码,已验证-CRC checksum of the source code for ethernet, ALTERA official code, verified
<adfadf> 在 2024-11-14 上传 | 大小:3kb | 下载:0

[VHDL编程verilog_uart

说明:verilog编写的uart源代码,altera官方代码,已验证-verilog prepared uart source code, altera official code, verified
<adfadf> 在 2024-11-14 上传 | 大小:4kb | 下载:0

[VHDL编程double_addsub

说明:双字的加减法的verilog源代码和testbench,已经过测试-verilog source code and testbench double word addition and subtraction, and has been tested
<adfadf> 在 2024-11-14 上传 | 大小:3kb | 下载:0

[VHDL编程pipeline_add

说明:pipeline式累加器的verilog代码和testbench文件,已验证-pipeline type accumulator verilog testbench code and documents, verified
<adfadf> 在 2024-11-14 上传 | 大小:4kb | 下载:0

[VHDL编程UD_DIVDER

说明:定制化分频器的verilog源代码,分频器变量已参数化,好用-Customized divider verilog source code, variable frequency divider parameterized, easy to use
<adfadf> 在 2024-11-14 上传 | 大小:3kb | 下载:0

[VHDL编程gray_counter

说明:altera官方格雷码计数器的verilog代码和testbench,已测试-altera official Gray code counter verilog code and testbench, have been tested
<adfadf> 在 2024-11-14 上传 | 大小:5kb | 下载:0

[VHDL编程parall_interf

说明:SPI是串行外设接口(Serial Peripheral Interface)的缩写。SPI,是一种高速的,全双工,同步的通信总线,并且在芯片的管脚上只占用四根线,节约了芯片的管脚,同时为PCB的布局上节省空间-Serial Peripheral Interface
<李长兴> 在 2024-11-14 上传 | 大小:1kb | 下载:0

[VHDL编程design

说明:浮点数是属于有理数中某特定子集的数的数字表示,在计算机中用以近似表示任意某个实数。-Floating point numbers are rational numbers belonging to a particular subset of the digital representation for an approximate representation of any real number in the computer.
<李长兴> 在 2024-11-14 上传 | 大小:2kb | 下载:0

[VHDL编程ADC_READ

说明:读取 模数转换器的数据 把读来的数据存在FIFI中-ADC read,Einlesen der Daten von ADC-Wandler dann in FIFO Speichern
<Aaron> 在 2024-11-14 上传 | 大小:1kb | 下载:0

[VHDL编程top_clock-plus

说明:在quartus ii上仿真24小时的时钟在输入基本的时钟信号后,秒数,分数,小时数的变化-After entering the basic clock signal, seconds, fractions, changes in the number of hours of simulation on a 24-hour clock quartus ii
<bajie> 在 2024-11-14 上传 | 大小:1.52mb | 下载:0

[VHDL编程LCD1602

说明:LCD1602液晶 用VHDL语言写的显示字符串-LCD1602 LCD with VHDL language to write the display string
<赵嘉楠> 在 2024-11-14 上传 | 大小:3.08mb | 下载:0

[VHDL编程half_integer

说明:数控分频器:以2.5分频为例的半整数分频器-half-integer frequency divider
<litong> 在 2024-11-14 上传 | 大小:208kb | 下载:0
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