[VHDL编程] Tristate-buffers

说明：本程序完成三态缓冲器的功能，采用硬件编程语言VHDL实现。-This procedure completion tristate buffers using hardware programming language VHDL implementation.
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[VHDL编程] multichannel-selector

说明：本程序实现了二选一多路选择器的硬件功能，采用VHDL语言编写而成。-This program implements a second election multiplexer hardware function, written in VHDL language.
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[VHDL编程] Serial-borrow-eight-subtracte

说明：本程序实现了串行借位的八位减法器，采用VHDL语言实现。-This program implements eight serial borrow subtractor, using VHDL language.
<杨好人> 在 2024-11-15 上传 | 大小：25kb | 下载：0

[VHDL编程] Digital-clock

说明：利用Quartus编程软件及EDA实验板（芯片为EP1C6Q240C8）完成数字钟设计，该数字钟有显示时、分和秒的功能。-When the Quartus programming software and EDA experiment board (chip EP1C6Q240C8) complete digital clock, digital clock showing the hours, minutes and seconds
<杨好人> 在 2024-11-15 上传 | 大小：91kb | 下载：0

[VHDL编程] My-And

说明：And port made with nand gates in Verilog
<john li> 在 2024-11-15 上传 | 大小：133kb | 下载：0

[VHDL编程] Oc_spi

说明：FPGA的SPI接口例子，功能成熟，可以参考-SPI Master Core Specification
<zht> 在 2024-11-15 上传 | 大小：77kb | 下载：0

[VHDL编程] I2c_v13

说明：FPGA的I2C模块实例代码，有说明文档，值得参考啦-FPGA I2C Model Sample Code Docs
<zht> 在 2024-11-15 上传 | 大小：210kb | 下载：0

[VHDL编程] controller

说明： Simple Microprocessor Design (ESD Book Chapter 3) Copyright 2001 Weijun Zhang Controller (control logic plus state register) VHDL FSM modeling- Simple Microprocessor Design (ESD Book Chapter 3) Copyrig
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[VHDL编程] memory

说明： Simple Microprocessor Design memory 256*16 8 bit address 16 bit data memory.vhd- Simple Microprocessor Design memory 256*16 8 bit address 16 bit data memory.vhd
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[VHDL编程] DSP

说明： FIR Digital Filter Design (DSP example) tested by Weijun Zhang, 04/2001 VHDL Data-Flow modeling KEYWORD: generate, array, range, constant and subtype- FIR Digital Filter Design (DSP example) tes
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[VHDL编程] Controller(FSM)

说明： Simple Bridge (ESD book figure 2.14) by Weijun Zhang, 04/2001 RT level design using Controller(FSM) + DataPath- Simple Bridge (ESD book figure 2.14) by Weijun Zhang, 04/2001 RT level design using
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[VHDL编程] GCD-CALCULATOR

说明： GCD CALCULATOR (ESD book figure 2.11) Weijun Zhang, 04/2001 we can put all the components in one document(gcd2.vhd) or put them in separate files this is the example of RT level modeling (FSM + DataP
<mohamed> 在 2024-11-15 上传 | 大小：2kb | 下载：0