[VHDL编程] dac_900

说明：DAC900芯片驱动的Verilog语言描述，亲测可用。另外的是FIR滤波代码和DDS波形发生器的代码。既可单独使用，也可以整合在一起。-DAC900 chips driven Verilog language descr iption, pro-test available. Another is the FIR filter code and DDS waveform generator code. Either used alon
<唐宏伟> 在 2024-11-17 上传 | 大小：42kb | 下载：0

[VHDL编程] ads822

说明：自己用Verilog语言写的ADS822芯片的驱动，亲测可用。其他并行ADC芯片也可以用。-Verilog language used to write their own drivers ADS822 chips, pro-test available. Other parallel ADC chips can also be used.
<唐宏伟> 在 2024-11-17 上传 | 大小：2kb | 下载：1

[VHDL编程] dual_ram

说明：在ISE中测试双端口RAM的源码，结合DDS可以通过Isim仿真直接测试RAM IP核的使用是否正常。-Dual-port RAM test source code in ISE, the binding DDS RAM IP core can be directly tested whether the use of the normal simulation.
<唐宏伟> 在 2024-11-17 上传 | 大小：2kb | 下载：0

[VHDL编程] camera_bfm

说明：ov7670摄像头功能总线模型的源代码和源代码仿真-ov7670 camera function bus model source code and source code emulation
<音速小飞> 在 2024-11-17 上传 | 大小：69kb | 下载：0

[VHDL编程] crc32

说明：该文件主要描述的是crc算法的实现，是8bit输入，输出的是32bit的crc校验码-The document is to achieve crc algorithm described is 8bit input, the output is a 32bit crc checksum
<音速小飞> 在 2024-11-17 上传 | 大小：230kb | 下载：0

[VHDL编程] FPGAforlcdDisplay

说明：FPGA ship FOR LCD display, the LCD is 12864.有兴趣的初学者可以看看，高手绕过。-FPGA ship FOR LCD display, the LCD is 12864 MODEL.
<wuweibiao> 在 2024-11-17 上传 | 大小：4.96mb | 下载：0

[VHDL编程] Quadrotor_control

说明：基于xilinx FPGA的四旋翼简单控制系统ISE14.1工程文件。于spartan-6上验证成功。-Quadrotor control system based on Xilinx FPGA.
<Rangi Lyu> 在 2024-11-17 上传 | 大小：1.51mb | 下载：0

[VHDL编程] conv

说明：16位的卷积器 直接套用公式编写，执行正确-conv
<李二> 在 2024-11-17 上传 | 大小：5.35mb | 下载：0

[VHDL编程] DAC

说明：DACADC资料，10bit300MSsDAC6V输出摆动； 10bit500MSPS分段DAC性能优化；用DAC产生Nyquist-WDM信号等-DACADC information, 10bit300MSsDAC6V output swing 10bit500MSPS segmented DAC performance optimization produced by DAC Nyquist-WDM signals
<wangfang> 在 2024-11-17 上传 | 大小：6.8mb | 下载：0

[VHDL编程] Test_96_Right2

说明：MCU配合FPGA控制驱动96路电机,其中MCU与FPGA间用SPI通信，本文件为FPGA部分verilog源程序-MCU with FPGA control and drive motors ，where MCU communicate with FPGA using SPI
<lingchen> 在 2024-11-17 上传 | 大小：3.17mb | 下载：0

[VHDL编程] p3structural

说明：To Design 1-bit Full Adder using Verilog HDL for all logic gates with switch and gate level modelling.
<Jogi> 在 2024-11-17 上传 | 大小：2kb | 下载：0

[VHDL编程] mb

说明：xilinx公司Microblaze核源文件，版本v7_10_a，语言VHDL，用于FPGA开发和DC综合-xilinx company Microblaze nuclear source file, version v7_10_a, language VHDL, and FPGA development for integrated DC
<陈礼锐> 在 2024-11-17 上传 | 大小：842kb | 下载：0