[VHDL编程] Key_interrupt

说明：（4）实验4：按键中断实验，完整的设计工程文件在Key_interrupt文件夹下-(4) Experiment 4: Key interruption experiments, complete design engineering files in Key_interrupt file folder
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[VHDL编程] count_display

说明：5）实验5：计数显示实验，完整的设计工程文件在count_display文件夹下-5) Experiment 5: count display experiment, a complete design engineering files in count_display file folder
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[VHDL编程] RS232

说明：（6）实验6：串口通讯实验，完整的设计工程文件在RS232文件夹下二、运行环境 程序在以下环境调试通过： （1）Windows XP； （2）Altera公司的Quartus II 8.0 for windows； （3）Altera公司的Nios II 8.0 IDE for windows； （4）Mentor公司的ModelSim SE 6.0；-(6) (2) Altera Corporation
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[VHDL编程] Flash

说明：（7）实验7：外部FLASH扩展实验，完整的设计工程文件在Flash文件夹下-(7) Experiment 7: the external FLASH expansion experiments complete design project files in the Flash file folder
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[VHDL编程] pwm_custom

说明：（8）实验8：添加用户组件外设实验，完整的设计工程文件在pwm_custom文件夹下 -(8) Experiment 8: add user components peripherals experiment, a complete design engineering files in pwm_custom file folder
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[VHDL编程] LL

说明：verilog语言描述的SDRAM程序代码。-verilog language to describe the the SDRAM procedure code.
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[VHDL编程] LL

说明：verilog语言的异步接口转换设计程序代码.-verilog language the asynchronous interface converter design code.
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[VHDL编程] LL

说明：verilog语言的计数器设计程序代码。-counter verilog language design code.
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[VHDL编程] LL

说明：verilog语言描述的异步FIFO设计。-verilog language to describe the asynchronous FIFO design.
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[VHDL编程] VGA_control

说明：介绍用VHDL实现vga控制的原理及方法，并提供了一个实例-Introduced the use of VHDL realization of a vga control principles and methods, and provides an example
<陈> 在 2025-02-10 上传 | 大小：2.02mb | 下载：0

[VHDL编程] hfjhtb

说明：整个ofdm系统的每一步功能的verilog实现-The ofdm system as a whole every step functions verilog implementation
<hfj> 在 2025-02-10 上传 | 大小：1.43mb | 下载：0

[VHDL编程] di4

说明：1、 用16*16点阵的发光二极管逐行扫描显示“一”字。 2、 输入为四位二进制矢量。 3、 采用行列扫描的方法，用四位二进制做行选信号（总共16列），如选中第一行，则扫描第一行之中哪些行是高电平（1），哪些行是低电平（0） 为高电平的则点亮，为低电平的不亮。 4、 注意扫描频率的设置，扫描频率足够快，才能动态扫描“一”字。 5、 程序由行扫描模块和显示模块构成。 行扫描模块输入为一个时钟信号和重置信号，输出为4位二
<吴凤妹> 在 2025-02-10 上传 | 大小：1kb | 下载：0