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[VHDL编程] statemachine
说明:RTL级verilog代码 用状态机实现 将输入数据写入16位寄存器,输出其除以7所得的余数(4位)-RTL-lever verilog code Using FSM to realize the following function:input the data into a 16bit register, divide it by 7, and output the 4-bit remainder<Gary> 在 2025-03-07 上传 | 大小:1kb | 下载:0
[单片机(51,AVR,MSP430等)] MI
说明:这是一个非常好的升降仪器测试程序,对你会有很大帮助-This is a very good lift equipment testing procedures, there will be a great help to you<zhangdi> 在 2025-03-07 上传 | 大小:1kb | 下载:0
[单片机(51,AVR,MSP430等)] uart2
说明:uart routine for transmitting characters a to z . -uart routine for transmitting characters a to z .<morning> 在 2025-03-07 上传 | 大小:1kb | 下载:0
[单片机(51,AVR,MSP430等)] shanshuoxianshi5bingqiezuoyixianshi
说明:HD7279的测试显示程序,尤其是时序脉冲很好-The HD7279 ,it is a buitful file,I think you will be like it<陶将> 在 2025-03-07 上传 | 大小:1kb | 下载:0