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  1. xiayuwen

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  2. verilogHDL语言学习的相关资料,非常好用,还有夏宇闻的课件学verilog的应该都知道夏老师的-Language Learning verilogHDL relevant information, very easy to use, as well as courseware Xia Xue Wen verilog should all know the summer of teachers
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-27
    • 文件大小:1.46mb
    • 提供者:kinki
  1. xiayuwen

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  2. 北航夏宇闻老师编写的关于从算法设计到硬线逻辑的实现的文章。-XIA Yu-Wen Beihang teacher reports on the algorithm design to hard-line logic, the realization of the article.
  3. 所属分类:软件工程

    • 发布日期:2024-11-27
    • 文件大小:3.22mb
    • 提供者:juan
  1. Verilog-HDL-xiayuwen

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  2. 夏宇闻老师的经典教程,对Verlag语言感兴趣的朋友或初学FPGA的朋友是个不错的教程。-XIA Wen classic tutorial teachers, the language of the Verlag FPGA beginner interested friends or friends is a good tutorial.
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-27
    • 文件大小:11.55mb
    • 提供者:徐海龙
  1. xiayuwen

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  2. 本程序是夏宇闻老师的verilog数字系统设计教程中的E2PROM完整程序文件,包括信号产生模块,E2PROM读写模块,E2PROM模拟模块,并且在ISE上运行成功,测试正确,modelsim仿真成功-This program is the Xia Yu Wen digital system design tutorial E2PROM complete file, including the signal generation mod
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-27
    • 文件大小:49kb
    • 提供者:王建伟
  1. ppt

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  2. Verilog数字系统设计教程(夏宇闻)例题源程序 ppt-Verilog digital system design course (XiaYuwen) sample source program PPT
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-27
    • 文件大小:279kb
    • 提供者:陈权标
  1. Verilog-xiayuwen-text

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  2. Verilog数字系统设计教程(夏宇闻)例题源程序-Verilog digital system design course (XiaYuwen) sample source program
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-27
    • 文件大小:259kb
    • 提供者:陈权标
  1. Verilog-example-by-xiayuwen

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  2. 这本书是夏宇文老师在几年前编写的,非常是和初学者,里面有哦对verilog 的详细讲解-a book write by xiyuwen ,This book provides a detailed explanation of verilog
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-27
    • 文件大小:1.3mb
    • 提供者:pioneer
  1. VerilogHDL

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  2. 非常好的夏宇闻的veilogHDL语言学习资料,非常难得的。-Very good the xiayuwen of verilog HDL of language learning materials, and very rare.
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-27
    • 文件大小:21.74mb
    • 提供者:曹爽
  1. Verilog-DATAS-xiayuwen

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  2. 3.1 引言 3.2 Verilog HDL基本结构 3.3 数据类型及常量、变量 3.4 运算符及表达式 3.5 语句 3.6 赋值语句和块语句 3.7 条件语句3.8 循环语句 3.9 结构说明语句 3.10 编译预处理语句 3.11 语句的顺序执行与并行执行 3.12 不同抽象级别的Verilog HDL模型 3.13 设计技巧-3.1 Introduction 3.2 Veril
  3. 所属分类:文件格式

    • 发布日期:2024-11-27
    • 文件大小:1.28mb
    • 提供者:fanzzu
  1. SystemVerilog_by_XiaYuwen

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  2. Classic System Verilog PPT by XiaYuwen
  3. 所属分类:其他小程序

    • 发布日期:2024-11-27
    • 文件大小:133kb
    • 提供者:fissird

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