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  1. clock3

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  2. 一个带闹钟的分为12 和24 小时的数字时钟。只有24小时有闹钟,都是原件例化,用的是位置关联-With alarm clock into a 12- and 24-hour digital clock. Only 24-hour alarm, all of the original case, the location associated with the
  3. 所属分类:VHDL编程

    • 发布日期:2024-12-23
    • 文件大小:716kb
    • 提供者:李青
  1. plj

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  2. 使用vhdl语言原件例化设计数字频率计,并用6位7段数码管计数。模块包括:十进制计数器,6位10进制计数器,Reg24 锁存器、Fp 分频器、Ctrl 频率控制器、Disp 动态显示。(The digital frequency meter is designed by using VHDL language as an example and counted by 6-bit 7-segment digital tube. Modul
  3. 所属分类:其他小程序

    • 发布日期:2024-12-23
    • 文件大小:11kb
    • 提供者:贵阳余文乐

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