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文件名称:16bit_booth_multiplier_STG

  • 所属分类：
  • 嵌入式/单片机编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2008-10-13
  • 文件大小：
  • 2.19kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • se***
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

verilog程序，实现两个16bit数乘法，采用booth算法，基于状态机实现，分层次为datapath和controller两个子模块，testBench测试通过-verilog procedures, two 16bit multiplication, the algorithm used booth. Based on the state machine achieved at different levels for datapath controller and two sub-modules, testBench the test
(系统自动生成,下载前可以参看下载内容)

下载文件列表

压缩包 : 8736104516bit_booth_multiplier_stg.rar 列表
Controller.v
Datapath.v
testBench.v
Booth_Multiplier_STG.v

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