文件名称:SPtransform
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Verilog HDL编写的串并转换。采用iout类型口。包含源文件和测试文件。用Modsim编译。-Verilog HDL Series and the preparation of the conversion. I used iout types. Includes source and test papers. Modsim compiler used.
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压缩包 : 5956487sptransform.rar 列表 tb_transform.v transform.v