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文件名称:拨码开关选择

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • 上传时间：
  • 2017-12-18
  • 文件大小：
  • 293kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • pet****
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verilog 拨码开关选择 fpga设计(verilog dfdjfjfdklf kfndsvnm)
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文件名大小更新时间
Experiment_2.1
Experiment_2.1\DSW
Experiment_2.1\DSW\DSW.asm.rpt 7571 2014-04-11
Experiment_2.1\DSW\DSW.cdf 291 2014-04-30
Experiment_2.1\DSW\DSW.done 26 2014-04-13
Experiment_2.1\DSW\DSW.fit.rpt 80193 2014-04-11
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Experiment_2.1\DSW\DSW.fit.summary 580 2014-04-11
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Experiment_2.1\DSW\DSW.map.summary 444 2014-04-11
Experiment_2.1\DSW\DSW.pin 27086 2014-04-11
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Experiment_2.1\DSW\DSW.qsf 3082 2014-04-30
Experiment_2.1\DSW\DSW.sof 240776 2014-04-11
Experiment_2.1\DSW\DSW.sta.rpt 12037 2014-04-11
Experiment_2.1\DSW\DSW.sta.summary 223 2014-04-11
Experiment_2.1\DSW\DSW.v 119 2014-04-11
Experiment_2.1\DSW\db
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Experiment_2.1\DSW\db\DSW.lpc.txt 1060 2014-04-11
Experiment_2.1\DSW\db\DSW.map.bpm 490 2014-04-11
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Experiment_2.1\DSW\db\DSW.map_bb.cdb 1012 2014-04-11
Experiment_2.1\DSW\db\DSW.map_bb.hdb 7839 2014-04-11
Experiment_2.1\DSW\db\DSW.map_bb.logdb 4 2014-04-11
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Experiment_2.1\DSW\db\DSW.pre_map.hdb 8484 2014-04-11
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Experiment_2.1\DSW\db\DSW.rtlv_sg_swap.cdb 177 2014-04-11
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Experiment_2.1\DSW\db\DSW.sgate_sm.rvd 211 2014-04-13
Experiment_2.1\DSW\db\DSW.sgdiff.cdb 984 2014-04-11
Experiment_2.1\DSW\db\DSW.sgdiff.hdb 8542 2014-04-11
Experiment_2.1\DSW\db\DSW.sld_design_entry.sci 197 2014-04-30
Experiment_2.1\DSW\db\DSW.sld_design_entry_dsc.sci 197 2014-04-11
Experiment_2.1\DSW\db\DSW.smart_action.txt 6 2014-04-11
Experiment_2.1\DSW\db\DSW.sta.qmsg 8425 2014-04-11
Experiment_2.1\DSW\db\DSW.sta.rdb 2509 2014-04-11
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Experiment_2.1\DSW\db\prev_cmp_DSW.qmsg 28962 2014-04-11
Experiment_2.1\DSW\incremental_db
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Experiment_2.1\DSW\incremental_db\compiled_partitions\DSW.root_partition.map.hdb 8182 2014-04-11
Experiment_2.1\DSW\incremental_db\compiled_partitions\DSW.root_partition.map.kpt 200 2014-04-11

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