文件名称:ddr
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ddr2控制器设计,适用于xilinx fpga,内含IP软核 -ddr2 controller design for xilinx fpga, embedded IP soft core
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下载文件列表
ddr
...\86872581wb-ddr.zip
...\DDR2-verilog
...\DDR2-verilog.rar
...\............\9.2
...\............\...\altclklock.v
...\............\...\chart
...\............\...\.....\鍥?-16.bmp
...\............\...\.....\鍥?-17.bmp
...\............\...\.....\鍥?-19.bmp
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...\............\...\.....\鍥?-27.bmp
...\............\...\ddr.cr.mti
...\............\...\ddr.mpf
...\............\...\ddr_Command.v
...\............\...\ddr_control_interface.v
...\............\...\ddr_data_path.v
...\............\...\ddr_sdram.v
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...\............\...\note.txt
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...\............\...\transcript
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...\............\...\....\altclklock
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...\............\...\....\..........\_primary.vhd
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...\............\...\....\.............\_primary.vhd
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...\ddr_kongzhiqi
...\.............\ddr_kongzhiqi
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...\DDR_SDRAM_verilog.rar
...\wb-ddr
...\......\wb_ddr
...\......\......\.bzrignore
...\......\......\bench
...\......\......\.....\lac
...\......\......\.....\...\dp_ram.v
...\......\......\.....\...\lac.v
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...\......\......\boards
...\......\......\......\xilinx-s3esk
...\......\......\......\............\Makefile
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...\......\......\......\............\system.v
...\......\......\......\............\system.xst
...\......\......\......\............\system_sim.save