文件名称:ad_rx_module
介绍说明－－下载内容均来自于网络，请自行研究使用
基于verilog的串口通信接收部分代码，欢迎下载交流！-Receiving part of the code verilog based serial communication, welcome to download the exchange!
(系统自动生成,下载前可以参看下载内容)
下载文件列表
ad_rx_module\ad_rx_module.asm.rpt
............\ad_rx_module.done
............\ad_rx_module.fit.rpt
............\ad_rx_module.fit.smsg
............\ad_rx_module.fit.summary
............\ad_rx_module.flow.rpt
............\ad_rx_module.inc
............\ad_rx_module.map.rpt
............\ad_rx_module.map.summary
............\ad_rx_module.pin
............\ad_rx_module.qpf
............\ad_rx_module.qsf
............\ad_rx_module.sof
............\ad_rx_module.sta.rpt
............\ad_rx_module.sta.summary
............\ad_rx_module.v
............\db\ad_rx_module.amm.cdb
............\..\ad_rx_module.asm.qmsg
............\..\ad_rx_module.asm.rdb
............\..\ad_rx_module.asm_labs.ddb
............\..\ad_rx_module.cbx.xml
............\..\ad_rx_module.cmp.bpm
............\..\ad_rx_module.cmp.cdb
............\..\ad_rx_module.cmp.hdb
............\..\ad_rx_module.cmp.kpt
............\..\ad_rx_module.cmp.logdb
............\..\ad_rx_module.cmp.rdb
............\..\ad_rx_module.cmp_merge.kpt
............\..\ad_rx_module.cycloneive_io_sim_cache.31um_ff_1200mv_0c_fast.hsd
............\..\ad_rx_module.cycloneive_io_sim_cache.31um_ss_1200mv_0c_slow.hsd
............\..\ad_rx_module.cycloneive_io_sim_cache.31um_ss_1200mv_85c_slow.hsd
............\..\ad_rx_module.db_info
............\..\ad_rx_module.fit.qmsg
............\..\ad_rx_module.hier_info
............\..\ad_rx_module.hif
............\..\ad_rx_module.idb.cdb
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............\..\ad_rx_module.lpc.rdb
............\..\ad_rx_module.lpc.txt
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............\..\ad_rx_module.map.cdb
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............\..\ad_rx_module.map.logdb
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............\..\ad_rx_module.map_bb.cdb
............\..\ad_rx_module.map_bb.hdb
............\..\ad_rx_module.map_bb.logdb
............\..\ad_rx_module.pre_map.cdb
............\..\ad_rx_module.pre_map.hdb
............\..\ad_rx_module.rpp.qmsg
............\..\ad_rx_module.rtlv.hdb
............\..\ad_rx_module.rtlv_sg.cdb
............\..\ad_rx_module.rtlv_sg_swap.cdb
............\..\ad_rx_module.sgate.rvd
............\..\ad_rx_module.sgate_sm.rvd
............\..\ad_rx_module.sgdiff.cdb
............\..\ad_rx_module.sgdiff.hdb
............\..\ad_rx_module.sld_design_entry.sci
............\..\ad_rx_module.sld_design_entry_dsc.sci
............\..\ad_rx_module.smart_action.txt
............\..\ad_rx_module.sta.qmsg
............\..\ad_rx_module.sta.rdb
............\..\ad_rx_module.sta_cmp.8_slow_1200mv_85c.tdb
............\..\ad_rx_module.syn_hier_info
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............\..\ad_rx_module.tiscmp.fastest_slow_1200mv_85c.ddb
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............\..\ad_rx_module.tiscmp.slow_1200mv_85c.ddb
............\..\ad_rx_module.tis_db_list.ddb
............\..\ad_rx_module.tmw_info
............\..\logic_util_heursitic.dat
............\..\prev_cmp_ad_rx_module.qmsg
............\detect_module.v
............\detect_module.v.bak
............\incremental_db\compiled_partitions\ad_rx_module.db_info
............\..............\...................\ad_rx_module.root_partition.cmp.cdb
............\..............\...................\ad_rx_module.root_partition.cmp.dfp
............\..............\...................\ad_rx_module.root_partition.cmp.hdb
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............\..............\...................\ad_rx_module.root_partition.map.dpi
............\..............\...................\ad_rx_module.root_partition.map.hbdb.cdb
............\..............\...................\ad_rx_module.root_partition.map.hbdb.hb_info
............\..............\...........