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文件名称:txmit

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2015-09-21
  • 文件大小：
  • 1kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • L***
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

uart设计，发送模块，无校验位。先输出一个低电平的起始位，然后从低到高输出8个数据位，接着是可选的奇偶校验位（这里没有），最后是高电平的停止位。-uart design, transmit module, no parity. First output of the start bit of a low level, and　low to high output 8 data bits, then the optional parity bit (there is no), the last stop bit is high.
(系统自动生成,下载前可以参看下载内容)

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txmit.v

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